參數(shù)資料
型號： MC68HC908GR16AVFAE
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP48
封裝： 7 X 7 MM, 1.40 MM HEIGHT, 0.50 MM PITCH, LEAD FREE, LQFP-48
文件頁數(shù)： 32/270頁
文件大小： 1890K
代理商： MC68HC908GR16AVFAE
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Port E
MC68HC908GR16A Data Sheet, Rev. 1.0
Freescale Semiconductor
127
12.5.3 Port D Input Pullup Enable Register
The port D input pullup enable register (PTDPUE) contains a software configurable pullup device for each
of the eight port D pins. Each bit is individually configurable and requires that the data direction register,
DDRD, bit be configured as an input. Each pullup is automatically and dynamically disabled when a port
bit’s DDRD is configured for output mode.
PTDPUE7–PTDPUE0 — Port D Input Pullup Enable Bits
These writable bits are software programmable to enable pullup devices on an input port bit.
1 = Corresponding port D pin configured to have internal pullup
0 = Corresponding port D pin has internal pullup disconnected
12.6 Port E
Port E is a 6-bit special-function port that shares two of its pins with the enhanced serial communications
interface (ESCI) module.
12.6.1 Port E Data Register
The port E data register contains a data latch for each of the six port E pins.
PTE5-PTE0 — Port E Data Bits
These read/write bits are software-programmable. Data direction of each port E pin is under the control
of the corresponding bit in data direction register E. Reset has no effect on port E data.
NOTE
Data direction register E (DDRE) does not affect the data direction of port
E pins that are being used by the ESCI module. However, the DDRE bits
always determine whether reading port E returns the states of the latches
or the states of the pins. See Table 12-6.
Address:
$000F
Bit 7
6
54
321
Bit 0
Read:
PTDPUE7
PTDPUE6
PTDPUE5
PTDPUE4
PTDPUE3
PTDPUE2
PTDPUE1
PTDPUE0
Write:
Reset:
00
000
0
Figure 12-16. Port D Input Pullup Enable Register (PTDPUE)
Address:
$0008
Bit 7
654321
Bit 0
Read:
0
PTE5
PTE4
PTE3
PTE2
PTE1
PTE0
Write:
Reset:
Unaffected by reset
Alternative
Function:
RxD
TxD
= Unimplemented
Figure 12-17. Port E Data Register (PTE)
相關(guān)PDF資料
PDF描述
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