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參數(shù)資料
| 型號： | MC68HC705B16VFNR2 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC52 |
| 封裝： | PLASTIC, LCC-52 |
| 文件頁數(shù)： | 80/298頁 |
| 文件大?。?/td> | 3532K |
| 代理商： | MC68HC705B16VFNR2 |
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MOTOROLA
C-8
MC68HC05B6
Rev. 4
MC68HC705B5
14
1 (set)
–
The watchdog will be active during WAIT mode.
0 (clear) –
The watchdog system will be disabled during WAIT mode.
PBPD – Port B pull-down resistors
1 (set)
–
Pull-down resistors are connected to all 8 pins of port B; the
pull-down, RPD, is active only while the pin is an input.
0 (clear) –
No pull-down resistors are connected.
PCPD — Port C pull-down resistors
1 (set)
–
Pull-down resistors are connected to all 8 pins of port C; the
pull-down, RPD, is active only while the pin is an input.
0 (clear) –
No pull-down resistors are connected.
The combination of bit 0 and bit 1 allows the option of pull-down resistors on 0, 8 or 16 inputs. This
feature is not available on the MC68HC05B6.
C.5
Bootstrap mode
The 432 bytes of self-check rmware on the MC68HC05B6 are replaced with 496 bytes of
bootstrap rmware. The bootstrap rmware located from $0200 to $02FF and $1F00 to $1FEF can
be used to program the EPROM, to check if the EPROM is erased and to load and execute data
in RAM.
When the MC68HC705B5 is placed in the bootstrap mode, the bootstrap reset vector is fetched
and the bootstrap rmware starts to execute. Table C-2 shows the conditions required to enter
each level of bootstrap mode on the rising edge of RESET. The hold time on the IRQ and TCAP1
pins after the external RESET pin is brought high is two clock cycles.
Table C-2 Mode of operation selection
IRQ pin
TCAP1 pin
PD2
PD3
PD4
Mode
VSS to VDD
x
Single chip
+ 9 Volts
VDD
0
1
0
Erased EPROM verication
+ 9 Volts
VDD
x
0
EPROM parallel bootstrap load
+ 9 Volts
VDD
x
1
EPROM (RAM) serial bootstrap load and execute
+ 9 Volts
VDD
x
0
1
RAM parallel bootstrap load and execute
x = Don’t care
TPG
168
05B6Book Page 8 Tuesday, April 6, 1999 8:24 am
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