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參數(shù)資料
| 型號： | MC68HC11E9CFU2 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | QFP-64 |
| 文件頁數(shù)： | 53/242頁 |
| 文件大?。?/td> | 1672K |
| 代理商： | MC68HC11E9CFU2 |
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Timing Systems
M68HC11E Family Data Sheet, Rev. 5.1
146
Freescale Semiconductor
9.7.2 Pulse Accumulator Count Register
This 8-bit read/write register contains the count of external input events at the PAI input or the
accumulated count. The PACNT is readable even if PAI is not active in gated time accumulation mode.
The counter is not affected by reset and can be read or written at any time. Counting is synchronized to
the internal PH2 clock so that incrementing and reading occur during opposite half cycles.
9.7.3 Pulse Accumulator Status and Interrupt Bits
The pulse accumulator control bits, PAOVI and PAII, PAOVF and PAIF, are located within timer registers
TMSK2 and TFLG2.
PAOVI and PAOVF — Pulse Accumulator Interrupt Enable and Overflow Flag
The PAOVF status bit is set each time the pulse accumulator count rolls over from $FF to $00. To clear
this status bit, write a 1 in the corresponding data bit position (bit 5) of the TFLG2 register. The PAOVI
control bit allows configuring the pulse accumulator overflow for polled or interrupt-driven operation
and does not affect the state of PAOVF. When PAOVI is 0, pulse accumulator overflow interrupts are
inhibited, and the system operates in a polled mode, which requires that PAOVF be polled by user
software to determine when an overflow has occurred. When the PAOVI control bit is set, a hardware
interrupt request is generated each time PAOVF is set. Before leaving the interrupt service routine,
software must clear PAOVF by writing to the TFLG2 register.
Address:
$1027
Bit 7
654321
Bit 0
Read:
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Write:
Reset:
Indeterminate after reset
Figure 9-26. Pulse Accumulator Count Register (PACNT)
Address:
$1024
Bit 7
654321
Bit 0
Read:
TOI
RTII
PAOVI
PAII
PR1
PR0
Write:
Reset:
00000000
= Unimplemented
Figure 9-27. Timer Interrupt Mask 2 Register (TMSK2)
Address:
$1025
Bit 7
654321
Bit 0
Read:
TOF
RTIF
PAOVF
PAIF
Write:
Reset:
00000000
= Unimplemented
Figure 9-28. Timer Interrupt Flag 2 Register (TFLG2)
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC711E20VFU2 | 8-BIT, OTPROM, 2 MHz, MICROCONTROLLER, PQFP64 |
| MC68L11E1FNE2 | 8-BIT, 2 MHz, MICROCONTROLLER, PQCC52 |
| MC68L11E9FN2 | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PQCC52 |
| MC68HC711E20CFS2 | 8-BIT, UVPROM, 2 MHz, MICROCONTROLLER, CQCC52 |
| MC68HC11E9MB2 | 8-BIT, MROM, 2 MHz, MICROCONTROLLER, PDIP56 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC11E9CFU3 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Microcontrollers |
| MC68HC11E9CPB2 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-channel, 8-bit analog-to-digital (A/D) converter |
| MC68HC11E9CPB3 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-channel, 8-bit analog-to-digital (A/D) converter |
| MC68HC11E9FN3 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-channel, 8-bit analog-to-digital (A/D) converter |
| MC68HC11E9FU3 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Microcontrollers |
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