參數(shù)資料
型號: MC68HC08JK3DW
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MICROCONTROLLER, PDSO20
封裝: SOIC-20
文件頁數(shù): 91/235頁
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代理商: MC68HC08JK3DW
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Computer Operating Properly (COP)
Technical Data
MC68H(R)C908JL3E/JK3E/JK1E Rev. 1.0
180
Computer Operating Properly (COP)
MOTOROLA
15.3 Functional Description
Figure 15-1 shows the structure of the COP module.
Figure 15-1. COP Block Diagram
The COP counter is a free-running 6-bit counter preceded by the 12-bit
system integration module (SIM) counter. If not cleared by software, the
COP counter overflows and generates an asynchronous reset after
218 – 24 or 213 – 24 2OSCOUT cycles; depending on the state of the
COP rate select bit, COPRS, in configuration register 1. With a 218 – 24
2OSCOUT cycle overflow option, a 8MHz crystal gives a COP timeout
period of 32.766 ms. Writing any value to location $FFFF before an
overflow occurs prevents a COP reset by clearing the COP counter and
stages 12 through 5 of the SIM counter.
COPCTL WRITE
2OSCOUT
RESET VECTOR FETCH
SIM RESET CIRCUIT
RESET STATUS REGISTER
INTERNAL RESET SOURCES(1)
SIM
CLEAR
STA
G
ES
5
–12
12-BIT SIM COUNTER
CLE
A
R
ALL
STAGES
COPD (FROM CONFIG1)
RESET
COPCTL WRITE
CLEAR
COP MODULE
COPEN (FROM SIM)
COP COUNTER
NOTE:
1. See SIM section for more details.
COP CLOCK
COP
TIMEOUT
COP RATE SEL
(COPRS FROM CONFIG1)
6-BIT COP COUNTER
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