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參數(shù)資料
| 型號(hào)： | MC68HC08JB1DWE |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PDSO20 |
| 封裝： | SOIC-20 |
| 文件頁(yè)數(shù)： | 14/216頁(yè) |
| 文件大?。?/td> | 2384K |
| 代理商： | MC68HC08JB1DWE |
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Technical Data
MC68HC08JB1 — Rev. 2.1
110
Freescale Semiconductor
9.5.5 Low-Speed Device
Low-speed devices are configured by the position of a pull-up resistor on
the USB D– pin of the MCU. Low-speed devices are terminated as
shown in Figure 9-9 with the pull-up on the D– line.
Figure 9-9. External Low-Speed Device Configuration
For low-speed transmissions, the transmitter’s EOP width must be
between 1.25
s and 1.50s. These ranges include timing variations due
to differential buffer delay and rise/fall time mismatches and to noise and
other random effects. A low-speed receiver must accept a 670ns SE0
followed by a J transition as a valid EOP. An SE0 shorter than
330ns or an SE0 not followed by a J transition are rejected as an EOP.
Any SE0 that is 8
s or longer is automatically a reset.
9.6 Clock Requirements
The low-speed data rate is nominally 1.5Mbps. The OSCXCLK signal
driven by the oscillator circuits is the clock source for the USB module
and requires that a 6-MHz oscillator circuit be connected to the OSC1
and OSC2 pins. The permitted frequency tolerance for low-speed
functions is approximately
±1.5% (15,000 ppm). This tolerance includes
inaccuracies from all sources: initial frequency accuracy, crystal
capacitive loading, supply voltage on the oscillator, temperature, and
aging. The jitter in the low-speed data rate must be less than 10ns.
1.5 k
D+
D–
VREG (3.3V)
USB LOW-SPEED CABLE
MCU
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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