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參數(shù)資料
| 型號(hào)： | MC68HC08JB1 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low-Cost, High-Performance M68HC08 Family of 8-Bit Microcontroller Units (MCUs)(低成本、高性能M68HC08系列的8位微控制器(MCUs)) |
| 中文描述： | 低成本，高性能M68HC08系列系列的8位微控制器單元（MCU）（低成本，高性能M68HC08系列系列的8位微控制器（MCU）的） |
| 文件頁(yè)數(shù)： | 91/214頁(yè) |
| 文件大?。?/td> | 2186K |
| 代理商： | MC68HC08JB1 |
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System Integration Module (SIM)
Low-Power Modes
MC68HC08JB1
—
Rev. 1.0
Technical Data
MOTOROLA
System Integration Module (SIM)
91
A module that is active during wait mode can wake up the CPU with an
interrupt if the interrupt is enabled. Stacking for the interrupt begins one
cycle after the WAIT instruction during which the interrupt occurred. In
wait mode, the CPU clocks are inactive. Refer to the wait mode
subsection of each module to see if the module is active or inactive in
wait mode. Some modules can be programmed to be active in wait
mode.
Wait mode can also be exited by a reset. If the COP disable bit, COPD,
in the mask option register is logic 0, then the computer operating
properly module (COP) is enabled and remains active in wait mode.
Figure 8-13. Wait Mode Entry Timing
Figure 8-14
and
Figure 8-15
show the timing for WAIT recovery.
Figure 8-14. Wait Recovery from Interrupt
WAIT ADDR + 1
SAME
SAME
IAB
IDB
PREVIOUS DATA
NEXT OPCODE
SAME
WAIT ADDR
SAME
R/W
NOTE: Previous data can be operand data or the WAIT opcode, depending on the
last instruction.
$6E0C
$6E0B
$00FF
$00FE
$00FD
$00FC
$A6
$A6
$01
$0B
$6E
$A6
IAB
IDB
EXITSTOPWAIT
NOTE: EXITSTOPWAIT = RST pin or CPU interrupt interrupt
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