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參數(shù)資料
| 型號： | MC68HC08GP16ACB |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PDIP42 |
| 封裝： | SDIP-42 |
| 文件頁數(shù)： | 187/286頁 |
| 文件大小： | 3807K |
| 代理商： | MC68HC08GP16ACB |
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Electrical Specifications
5.0-V Control Timing
MC68HC08GP32A MC68HC08GP16A
Data Sheet
MOTOROLA
Electrical Specifications
267
20.7 5.0-V Control Timing
20.8 3.0-V Control Timing
Characteristic(1)
Symbol
Min
Max
Unit
Frequency of operation(2)
Crystal option
External clock option(3)
fOSC
32
dc(4)
100
32.8
kHz
MHz
Internal operating frequency
fOP (fBUS)
—8.2
MHz
Internal clock period (1/fOP)tCYC
122
—
ns
RST input pulse width low(5)
tRL
50
—
ns
IRQ interrupt pulse width low(6) (edge-triggered)
tILIH
50
—
ns
IRQ interrupt pulse period
tILIL
Note(7)
—
tCYC
1. VSS = 0 Vdc; timing shown with respect to 20% VDD and 70% VDD unless otherwise noted.
2. See 20.16 Clock Generation Module Characteristics for more information.
3. No more than 10% duty cycle deviation from 50%
4. Some modules may require a minimum frequency greater than dc for proper operation. See appropriate table for this in-
formation.
5. Minimum pulse width reset is guaranteed to be recognized. It is possible for a smaller pulse width to cause a reset.
6. Minimum pulse width is for guaranteed interrupt. It is possible for a smaller pulse width to be recognized.
7. The minimum period, tILIL, should not be less than the number of cycles it takes to execute the interrupt service routine
plus tCYC.
Characteristic(1)
Symbol
Min
Max
Unit
Frequency of operation(2)
Crystal option
External clock option(3)
fOSC
32
dc(4)
100
16.4
kHz
MHz
Internal operating frequency
fOP (fBUS)
—4.1
MHz
Internal clock period (1/fOP)tCYC
244
—
ns
RST input pulse width low(5)
tIRL
125
—
ns
IRQ interrupt pulse width low(6) (edge-triggered)
tILIH
125
—
ns
IRQ interrupt pulse period
tILIL
Note(7)
—
tCYC
1. VSS = 0 Vdc; timing shown with respect to 20% VDD and 70% VDD unless otherwise noted.
2. See 20.16 Clock Generation Module Characteristics for more information.
3. No more than 10% duty cycle deviation from 50%
4. Some modules may require a minimum frequency greater than dc for proper operation. See appropriate table for this in-
formation.
5. Minimum pulse width reset is guaranteed to be recognized. It is possible for a smaller pulse width to cause a reset.
6. Minimum pulse width is for guaranteed interrupt. It is possible for a smaller pulse width to be recognized.
7. The minimum period, tILIL, should not be less than the number of cycles it takes to execute the interrupt service routine
plus tCYC.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| MC68HC08GP16AVFB | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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