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Computer Operating Properly (COP)
Technical Data
MC68HC08BD24 — Rev. 1.0
220
Computer Operating Properly (COP)
MOTOROLA
17.4.5 Internal Reset
An internal reset clears the COP prescaler and the COP counter.
17.4.6 Reset Vector Fetch
A reset vector fetch occurs when the vector address appears on the data
bus. A reset vector fetch clears the COP prescaler.
17.4.7 COPD (COP Disable)
The COPD signal reflects the state of the COP disable bit (COPD) in the
configuration register 1 (see Figure 17-2).
17.4.8 COPRS (COP Rate Select)
The COPRS signal reflects the state of the COP rate select bit (COPRS)
in the configuration register 1(see Figure 17-2).
COPRS — COP Rate Select Bit
COPRS selects the COP timeout period. Reset clears COPRS.
1 = COP timeout period = 213 – 24 OSCXCLK cycles
0 = COP timeout period = 218 – 24 OSCXCLK cycles
COPD — COP Disable Bit
COPD disables the COP module.
1 = COP module disabled
0 = COP module enabled
Address:
$001F
Bit 7
654321
Bit 0
Read:
0000
SSREC
COPRS
STOP
COPD
Write:
Reset:
00000000
= Unimplemented
Figure 17-2. Configuration Register 1 (CONFIG1)
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PDF描述 |
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