參數(shù)資料
型號： MC68HC08AZ32
廠商： Motorola, Inc.
英文描述： 8-Bit Microcontroller Units (MCU).(8位微控制器)
中文描述： 8位微控制器單元（MCU）。（8位微控制器）
文件頁數(shù)： 98/424頁
文件大小： 3738K
代理商： MC68HC08AZ32
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Clock Generator Module (CGM)
MC68HC08AZ32
96
Clock Generator Module (CGM)
MOTOROLA
PLL circuits
The PLL consists of the following circuits:
Voltage-controlled oscillator (VCO)
Modulo VCO frequency divider
Phase detector
Loop filter
Lock detector
The operating range of the VCO is programmable for a wide range of
frequencies and for maximum immunity to external noise, including
supply and CGMXFC noise. The VCO frequency is bound to a range
from roughly one-half to twice the center-of-range frequency, f
VRS
.
Modulating the voltage on the CGMXFC pin changes the frequency
within this range. By design, f
VRS
is equal to the nominal center-of-range
frequency, f
NOM
, (4.9152MHz) times a linear factor L, or (L)f
NOM
.
CGMRCLK is the PLL reference clock, a buffered version of CGMXCLK.
CGMRCLK runs at a frequency f
RCLK
, and is fed to the PLL through a
buffer. The buffer
output is the final reference clock, CGMRDV, running
at a frequency f
RDV
= f
RCLK
.
The VCO’s output clock, CGMVCLK, running at a frequency f
VCLK
, is fed
back through a programmable modulo divider. The modulo divider
reduces the VCO clock by a factor N. The divider
’
s output is the VCO
feedback clock, CGMVDV, running at a frequency f
VDV
= f
VCLK
/N. (See
Programming the PLL
on page 99 for more information).
The phase detector then compares the VCO feedback clock, CGMVDV,
with the final reference clock, CGMRDV. A correction pulse is generated
based on the phase difference between the two signals. The loop filter
then slightly alters the DC voltage on the external capacitor connected
to CGMXFC based on the width and direction of the correction pulse.
The filter can make fast or slow corrections depending on its mode,
described in
Acquisition and tracking modes
on page 97. The value of
the external capacitor and the reference frequency determines the
speed of the corrections and the stability of the PLL.
The lock detector compares the frequencies of the VCO feedback clock,
CGMVDV, and the final reference clock, CGMRDV. Therefore, the
6-cgm
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PDF描述
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