參數(shù)資料
型號(hào): MC68HC05C9ACFN
廠商: MOTOROLA INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQCC44
封裝: PLASTIC, LCC-44
文件頁(yè)數(shù): 93/160頁(yè)
文件大?。?/td> 783K
代理商: MC68HC05C9ACFN
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NON-DISCLOSURE
AGREEMENT
REQUIRED
Interrupts
General Release Specification
MC68HC05C9A Rev. 4.0
38
Interrupts
MOTOROLA
When the current instruction is complete, the processor checks all
pending hardware interrupts. If interrupts are not masked (CCR I bit
clear) and if the corresponding interrupt enable bit is set, the processor
proceeds with interrupt processing; otherwise, the next instruction is
fetched and executed.
If an external interrupt and a timer, SCI, or SPI interrupt are pending at
the end of an instruction execution, the external interrupt is serviced first.
The SWI is executed the same as any other instruction, regardless of the
I-bit state.
Table 4-1 shows the relative priority of all the possible interrupt sources.
Figure 4-1 shows the interrupt processing flow.
Table 4-1. Vector Addresses for Interrupts and Resets
Function
Source
Local
Mask
Global
Mask
Priority
(1 = Highest)
Vector
Address
Reset
Power-On-Reset
None
1
$3FFE–$3FFF
RESET Pin
COP Watchdog
Software
Interrupt
(SWI)
User Code
None
Same Priority
As Instruction
$3FFC–$3FFD
External
Interrupt
IRQ Pin
Port B Pins
None
I Bit
2
$3FFA–$3FFB
Timer
Interrupts
ICF Bit
ICIE Bit
I Bit
3
$3FF8–$3FF9
OCF Bit
OCIE Bit
TOF Bit
TOIE Bit
SCI
Interrupts
TDRE Bit
TCIE Bit
I Bit
4
$3FF6–$3FF7
TC Bit
RDRF Bit
RIE Bit
OR BIt
IDLE Bit
ILIE Bit
SPI
Interrupts
SPIF Bit
SPIE
I Bit
5
$3FF4–$3FF5
MODF Bit
相關(guān)PDF資料
PDF描述
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