參數(shù)資料
型號: MC68EZ328PU16V
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: MICROPROCESSOR, PQFP100
封裝: 14 X 14 MM, 0.50 MM PITCH, PLASTIC, TQFP-100
文件頁數(shù): 17/246頁
文件大?。?/td> 2507K
代理商: MC68EZ328PU16V
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General-Purpose Timer
MOTOROLA
MC68EZ328 USERS MANUAL
9-3
FRRFree-Run/Restart
This bit controls how the timer operates after a capture event occurs. In free-run mode, the
timer continues running. In restart mode, the counter resets to 0x0000, then resumes
counting.
0 = Restart mode.
1 = Free-run mode.
CAPCapture Edge
This field controls the operation of the capture function. The DIRx bit in the corresponding
port register must be set to 0 for the capture function to operate correctly. Refer to for more
information.
00 = Disable the capture function.
01 = Capture on the rising edge and generate an interrupt.
10 = Capture on the falling edge and generate an interrupt.
11 = Capture on the rising or falling edges and generate an interrupt.
OMOutput Mode
This bit controls the output mode of the timer after a reference-compare event occurs. If the
CAP field is not set to 00, this bit has no function.
0 = Active-low pulse for one SYSCLK period.
1 = Toggle output.
IRQENInterrupt Request Enable
This bit enables an interrupt on a compare event.
0 = Disable the compare interrupt.
1 = Enable the compare interrupt.
CLKSOURCEClock Source
This field controls the source of the clock to the prescaler. The stop-count freezes the timer
at its current value.
000 = Stop count (clock disabled).
001 = SYSCLK to prescaler.
010 = SYSCLK divided by 16 to prescaler.
011 = TIN to prescaler.
1xx = 32kHz clock to prescaler.
TENTimer Enable
This bit enables the general-purpose timer.
0 = Timer is disabled (counter reset to 0x0000).
1 = Timer is enabled.
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PDF描述
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參數(shù)描述
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