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參數資料
| 型號： | MC68908GZ8VFJE |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 102/314頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MICROPROCESSOR 8BIT 32-LQFP |
| 標準包裝： | 250 |
| 系列： | HC08 |
| 核心處理器： | HC08 |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 連通性： | CAN，LIN，SCI，SPI |
| 外圍設備： | LVD，POR，PWM |
| 輸入/輸出數： | 21 |
| 程序存儲器容量： | 8KB（8K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 數據轉換器： | A/D 8x10b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 105°C |
| 封裝/外殼： | 32-LQFP |
| 包裝： | 托盤 |
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Enhanced Serial Communications Interface (ESCI) Module
MC68HC908GZ16 MC68HC908GZ8 Data Sheet, Rev. 4
190
Freescale Semiconductor
15.4.3.1 Character Length
The receiver can accommodate either 8-bit or 9-bit data. The state of the M bit in ESCI control register 1
(SCC1) determines character length. When receiving 9-bit data, bit R8 in ESCI control register 3 (SCC3)
is the ninth bit (bit 8). When receiving 8-bit data, bit R8 is a copy of the eighth bit (bit 7).
15.4.3.2 Character Reception
During an ESCI reception, the receive shift register shifts characters in from the RxD pin. The ESCI data
register (SCDR) is the read-only buffer between the internal data bus and the receive shift register.
After a complete character shifts into the receive shift register, the data portion of the character transfers
to the SCDR. The ESCI receiver full bit, SCRF, in ESCI status register 1 (SCS1) becomes set, indicating
that the received byte can be read. If the ESCI receive interrupt enable bit, SCRIE, in SCC2 is also set,
the SCRF bit generates a receiver CPU interrupt request.
15.4.3.3 Data Sampling
The receiver samples the RxD pin at the RT clock rate. The RT clock is an internal signal with a frequency
16 times the baud rate. To adjust for baud rate mismatch, the RT clock is resynchronized at these times
(see Figure 15-7):
After every start bit
After the receiver detects a data bit change from logic 1 to logic 0 (after the majority of data bit
samples at RT8, RT9, and RT10 returns a valid logic 1 and the majority of the next RT8, RT9, and
RT10 samples returns a valid logic 0)
To locate the start bit, data recovery logic does an asynchronous search for a logic 0 preceded by three
logic 1s. When the falling edge of a possible start bit occurs, the RT clock begins to count to 16.
Figure 15-7. Receiver Data Sampling
To verify the start bit and to detect noise, data recovery logic takes samples at RT3, RT5, and RT7.
Table 15-2 summarizes the results of the start bit verification samples.
Table 15-2. Start Bit Verification
RT3, RT5, and RT7 Samples
Start Bit Verification
Noise Flag
000
Yes
0
001
Yes
1
010
Yes
1
RT CLOCK
RESET
RT1
RT2
RT3
RT4
RT5
RT8
RT7
RT6
RT
11
RT
10
RT9
RT
15
RT
14
RT
13
RT
12
RT
16
RT1
RT2
RT3
RT4
START BIT
QUALIFICATION
START BIT
VERIFICATION
DATA
SAMPLING
SAMPLES
RT
CLOCK
RT CLOCK
STATE
START BIT
LSB
RxD
相關PDF資料 |
PDF描述 |
|---|---|
| MC68908GZ8VFAE | IC MCU 8BIT 8K FLASH 48-LQFP |
| MCF52258CVN66J | IC MCU 512KB FLASH 144MAPBGA |
| VE-B4B-IW-B1 | CONVERTER MOD DC/DC 95V 100W |
| VE-B44-IX-B1 | CONVERTER MOD DC/DC 48V 75W |
| VE-B0X-IX-B1 | CONVERTER MOD DC/DC 5.2V 75W |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC689P | 制造商:Motorola Inc 功能描述: |
| MC68A00CL | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-BIT MICROPROCESSING UNIT (MPU) |
| MC68A00CP | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-BIT MICROPROCESSING UNIT (MPU) |
| MC68A00CS | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-BIT MICROPROCESSING UNIT (MPU) |
| MC68A00L | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-BIT MICROPROCESSING UNIT (MPU) |
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