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參數(shù)資料
| 型號： | MC68340RP16V |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 16.78 MHz, MICROCONTROLLER, PPGA145 |
| 封裝： | PLASTIC, PGA-145 |
| 文件頁數(shù)： | 347/446頁 |
| 文件大?。?/td> | 1800K |
| 代理商： | MC68340RP16V |
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11-10
MC68340 USER’S MANUAL
MOTOROLA
11.7 AC TIMING SPECIFICATIONS (Continued)
3.3 V
3.3 V or
5.0 V
8.39 MHz
16.78 MHz
25.16 MHz
Num.
Characteristic
Symbol
Min
Max
Min
Max
Min
Max
Unit
85
DSCLK Cycle
tDSCCYC
2—2—2—
CLKOUT
86
CLKOUT High to FREEZE Asserted
tFRZA
0
100
0
50
0
35
ns
87
CLKOUT High to FREEZE Negated
tFRZN
0
100
0
50
0
35
ns
88
CLKOUT High to
IFETCH High Impedance
tIFZ
0
100
0
50
0
35
ns
89
CLKOUT High to
IFETCH Valid
tIF
0
100
0
50
0
35
ns
NOTES:
(a) The electrical specifications in this document for both the 8.39 and 16.78 MHz @ 3.3 V
±0.3 V are preliminary
and apply only to the appropriate MC68340V low voltage part.
(b) The 16.78-MHz specifications apply to the MC68340 @ 5.0 V
±5% operation.
(c) The 25.16 MHz @ 5.0 V
±5% electrical specifications are preliminary.
(d) For extended temperature parts T A = –40 to +85°C. These specifications are preliminary.
1.
All AC timing is shown with respect to 0.8 V and 2.0 V levels unless otherwise noted.
2.
This number can be reduced to 5 ns if strobes have equal loads.
3.
If multiple chip selects are used, the
CS width negated (#15) applies to the time from the negation of a heavily
loaded chip select to the assertion of a lightly loaded chip select.
4.
These hold times are specified with respect to
DS or CS on asynchronous reads and with respect to CLKOUT on
fast termination reads. The user is free to use either hold time for fast termination reads.
5.
If the asynchronous setup time (#47) requirements are satisfied, the
DSACK
≈ low to data setup time (#31) and
DSACK
≈ low to BERR low setup time (#48) can be ignored. The data must only satisfy the data-in to CLKOUT
low setup time (#27) for the following clock cycle:
BERR must only satisfy the late BERR low to CLKOUT low
setup time (#27A) for the following clock cycle.
6.
To ensure coherency during every operand transfer,
BG will not be asserted in response to BR until after cycles
of the current operand transfer are complete and
RMC is negated.
7.
In the absence of
DSACK
≈, BERR is an asynchronous input using the asynchronous setup time (#47).
8.
Specification #47A for 16.78 MHz @ 3.3 V
±0.3V will be 8 ns.
9.
During interrupt acknowledge cycles up to two wait states may be inserted by the processor between states S0
and S1.
相關PDF資料 |
PDF描述 |
|---|---|
| MC68340CPV16E | 32-BIT, 16.78 MHz, MICROCONTROLLER, PQFP144 |
| MC68340CFE16 | 32-BIT, 16.78 MHz, MICROCONTROLLER, CQFP144 |
| MC68341FT25 | 25.16 MHz, MICROPROCESSOR, PQFP160 |
| MC68341FT16V | 16.78 MHz, MICROPROCESSOR, PQFP160 |
| MC68360RC25VC | 32-BIT, 25 MHz, RISC MICROCONTROLLER, CPGA241 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68340RP25 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Integrated Processor with DMA User’s Manual |
| MC68340RP25B | 制造商:Motorola Inc 功能描述: |
| MC68340RP8V | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Integrated Processor with DMA User’s Manual |
| MC68340UM/AD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Product Brief Integrated Processor With DMA |
| MC68340UMAD | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Integrated Processor with DMA Usera??s Manual |
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