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參數(shù)資料
| 型號： | MC68331CFV20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | User’s Manual |
| 中文描述： | 32-BIT, 20.97 MHz, MICROCONTROLLER, PQFP144 |
| 封裝： | QFP-144 |
| 文件頁數(shù)： | 12/254頁 |
| 文件大?。?/td> | 1354K |
| 代理商： | MC68331CFV20 |
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MOTOROLA
xii
MC68331
USER’S MANUAL
(Continued)
Title
Figure
Page
LIST OF ILLUSTRATIONS
6-3
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6-5
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6-6
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A-19
B-1
B-2
D-1
D-2
QSPI RAM....................................................................................................... 6-7
Flowchart of QSPI Initialization Operation..................................................... 6-11
Flowchart of QSPI Master Operation (Part 1) ............................................... 6-12
Flowchart of QSPI Master Operation (Part 2) ............................................... 6-13
Flowchart of QSPI Master Operation (Part 3) ............................................... 6-14
Flowchart of QSPI Slave Operation (Part 1) ................................................. 6-15
Flowchart of QSPI Slave Operation (Part 2) ................................................. 6-16
SCI Transmitter Block Diagram..................................................................... 6-23
SCI Receiver Block Diagram......................................................................... 6-24
GPT Block Diagram......................................................................................... 7-2
Prescaler Block Diagram................................................................................. 7-9
Capture/Compare Unit Block Diagram.......................................................... 7-10
Input Capture Timing Example...................................................................... 7-12
Pulse Accumulator Block Diagram................................................................ 7-15
PWM Block Diagram..................................................................................... 7-16
CLKOUT Output Timing Diagram..................................................................A-12
External Clock Input Timing Diagram............................................................A-12
ECLK Output Timing Diagram.......................................................................A-12
Read Cycle Timing Diagram .........................................................................A-13
Write Cycle Timing Diagram..........................................................................A-14
Fast Termination Read Cycle Timing Diagram .............................................A-15
Fast Termination Write Cycle Timing Diagram..............................................A-16
Bus Arbitration Timing Diagram — Active Bus Case ....................................A-17
Bus Arbitration Timing Diagram — Idle Bus Case ........................................A-18
Show Cycle Timing Diagram.........................................................................A-18
Chip Select Timing Diagram..........................................................................A-19
Reset and Mode Select Timing Diagram.......................................................A-19
Background Debugging Mode Timing Diagram—Serial Communication......A-21
Background Debugging Mode Timing Diagram —Freeze Assertion.............A-21
ECLK Timing Diagram...................................................................................A-23
QSPI Timing — Master, CPHA = 0 ...............................................................A-25
QSPI Timing — Master, CPHA = 1 ...............................................................A-25
QSPI Timing — Slave, CPHA = 0 .................................................................A-26
QSPI Timing — Slave, CPHA = 1 .................................................................A-26
132-Pin Plastic Surface Mount Package Pin Assignments.............................B-2
144-Pin Plastic Surface Mount Package Pin Assignments.............................B-3
User Programming Model ...............................................................................D-2
Supervisor Programming Model Supplement..................................................D-2
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