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參數(shù)資料
| 型號(hào)： | MC14029BFELG |
| 廠商： | ON Semiconductor |
| 文件頁(yè)數(shù)： | 3/8頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC COUNTER BIN/DEC U/D 16SOEIAJ |
| 產(chǎn)品變化通告： | Product Discontinuation 30/Sept/2011 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | 4000B |
| 邏輯類型： | 二進(jìn)制計(jì)數(shù)器，十進(jìn)制 |
| 方向： | 上，下 |
| 元件數(shù)： | 1 |
| 每個(gè)元件的位元數(shù)： | 4 |
| 計(jì)時(shí)： | 同步 |
| 計(jì)數(shù)速率： | 10MHz |
| 觸發(fā)器類型： | 正邊沿 |
| 電源電壓： | 3 V ~ 18 V |
| 工作溫度： | -55°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.209"，5.30mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-SOEIAJ |
| 包裝： | 剪切帶 (CT) |
| 其它名稱： | MC14029BFELGOSCT |
MC14029B
http://onsemi.com
3
Characteristic
Symbol
VDD
All Types
Unit
Min
Typ (2.)
Max
Output Rise and Fall Time
tTLH, tTHL = (1.5 ns/pF) CL + 25 ns
tTLH, tTHL = (0.75 ns/pF) CL + 12.5 ns
tTLH, tTHL = (0.55 ns/pF) CL + 9.5 ns
tTLH,
tTHL
5.0
10
15
—
100
50
40
200
100
80
ns
Propagation Delay Time
Clk to Q
tPLH, tPHL = (1.7 ns/pF) CL + 230 ns
tPLH, tPHL = (0.66 ns/pF) CL + 97 ns
tPLH, tPHL = (0.5 ns/pF) CL + 75 ns
Clk to Cout
tPLH, tPHL = (1.7 ns/pF) CL + 230 ns
tPLH, tPHL = (0.66 ns/pF) CL + 97 ns
tPLH, tPHL = (0.5 ns/pF) CL + 75 ns
Cin to Cout
tPLH, tPHL = (1.7 ns/pF) CL + 95 ns
tPLH, tPHL = (0.66 ns/pF) CL + 47 ns
tPLH, tPHL = (0.5 ns/pF) CL + 35 ns
PE to Q
tPLH, tPHL = (1.7 ns/pF) CL + 230 ns
tPLH, tPHL = (0.66 ns/pF) CL + 97 ns
tPLH, tPHL = (0.5 ns/pF) CL + 75 ns
PE to Cout
tPLH, tPHL = (1. 7 ns/pF) CL + 465 ns
tPLH, tPHL = (0.66 ns/pF) CL + 192 ns
tPLH, tPHL = (0.5 ns/pF) CL + 125 ns
tPLH,
tPHL
5.0
10
15
—
200
100
90
400
200
180
ns
tPLH,
tPHL
5.0
10
15
—
250
130
85
500
260
190
ns
tPLH,
tPHL
5.0
10
15
—
175
50
360
120
100
ns
tPLH,
tPHL
5.0
10
15
—
235
100
80
470
200
160
ns
tPLH,
tPHL
5.0
10
15
—
320
145
105
640
290
210
ns
Clock Pulse Width
tW(cl)
5.0
10
15
180
80
60
90
40
30
—
ns
Clock Pulse Frequency
fcl
5.0
10
15
—
4.0
8.0
10
2.0
4.0
5.0
MHz
Preset Removal Time
The Preset Signal must be low prior to a positivegoing
transition of the clock.
trem
5.0
10
15
160
80
60
80
40
30
—
ns
Clock Rise and Fall Time
tr(cl)
tf(cl)
5.0
10
1 5
—
—
15
5
4
ms
Carry In Setup Time
tsu
5.0
10
15
150
60
40
75
30
20
—
ns
Up/Down Setup Time
5.0
10
15
340
140
100
170
70
50
—
ns
Binary/Decade Setup Time
5.0
10
15
320
140
100
160
70
50
—
ns
Preset Enable Pulse Width
tW
5.0
10
15
130
70
50
65
35
25
—
ns
1. The formulas given are for the typical characteristics only at 25_C.
2. Data labelled “Typ” is not to be used for design purposes but is intended as an indication of the IC’s potential performance.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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