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參數(shù)資料
| 型號： | MC14024BDR2G |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 4/8頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC COUNTER RIPPLE 7STAGE 14SOIC |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | 4000B |
| 邏輯類型： | 二進(jìn)制計(jì)數(shù)器 |
| 方向： | 上 |
| 元件數(shù)： | 1 |
| 每個元件的位元數(shù)： | 7 |
| 復(fù)位： | 異步 |
| 計(jì)數(shù)速率： | 12MHz |
| 觸發(fā)器類型： | 正，負(fù) |
| 電源電壓： | 3 V ~ 18 V |
| 工作溫度： | -55°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 14-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 14-SOICN |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | MC14024BDR2GOSDKR |
MC14024B
http://onsemi.com
4
Characteristic
Symbol
VDD
Min
Typ
(Note 6)
Max
Unit
Output Rise and Fall Time
tTLH, tTHL = (1.5 ns/pF) CL + 25 ns
tTLH, tTHL = (0.75 ns/pF) CL + 12.5 ns
tTLH, tTHL = (0.55 ns/pF) CL + 9.5 ns
tTLH,
tTHL
5.0
10
15
100
50
40
200
100
80
ns
Propagation Delay Time
Clock to Q1
tPLH, tPHL = (1.7 ns/pF) CL + 295 ns
tPLH, tPHL = (0.66 ns/pF) CL + 117 ns
tPLH, tPHL = (0.5 ns/pF) CL + 85 ns
Clock to Q7
tPLH, tPHL = (1.7 ns/pF) CL + 915 ns
tPLH, tPHL = (0.66 ns/pF) CL + 367 ns
tPLH, tPHL = (0.5 ns/pF) CL + 275 ns
Reset to Qn
tPLH, tPHL = (1.7 ns/pF) CL + 415 ns
tPLH, tPHL = (0.66 ns/pF) CL + 217 ns
tPLH, tPHL = (0.5 ns/pF) CL + 155 ns
tPLH,
tPHL
5.0
10
15
5.0
10
15
5.0
10
15
380
150
110
1000
400
300
500
250
180
600
230
175
2000
750
565
800
400
300
ns
Clock Pulse Width
tWH
5.0
10
15
500
165
125
200
60
40
ns
Reset Pulse Width
tWH
5.0
10
15
600
350
260
375
200
150
ns
Reset Removal Time
trem
5.0
10
15
625
190
145
250
75
50
ns
Clock Input Rise and Fall Time
tTLH, tTHL
5.0
10
15
1.0
8.0
200
s
ms
Input Pulse Frequency
fcl
5.0
10
15
2.5
8.0
12
1.0
3.0
4.0
MHz
5. The formulas given are for the typical characteristics only at 25_C.
6. Data labelled “Typ” is not to be used for design purposes but is intended as an indication of the IC’s potential performance.
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