參數(shù)資料
型號(hào)： MC13760VFR2
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 2/6頁(yè)
文件大?。?/td> 0K
描述： IC DIGITAL CELL REC 104-BGA
標(biāo)準(zhǔn)包裝： 1,500
類(lèi)型： 收發(fā)器
驅(qū)動(dòng)器/接收器數(shù)： 1/1
規(guī)程： 多協(xié)議
電源電壓： 2.775V
安裝類(lèi)型： 表面貼裝
封裝/外殼： 104-LFBGA
供應(yīng)商設(shè)備封裝： 104-BGA（10x10）
包裝： 帶卷 (TR)
其它名稱(chēng)： Q1146713
MC13760
2
MOTOROLA RF PRODUCTS DEVICE DATA
AGC Control
DCOCL
AGC
Amp
AGC
Warp
DCOCL
SPI
Control
2 Pole
1 Pole
Step
Atten
Step
Atten
Q
I
2 Pole
1 Pole
2 Pole
AGCI
On Channel
AGC Det.
On Channel
AGC Det.
+2 Quadrature
Generator
Step
Alternator
Control
Battery
Save
Battery
Save
Adapt
Timing
DIG_AFC
Enable
SPII
SPICLK
CEX
Tracking Loop &
BB Filter BW Control
24 Bit
Adder
Addressable Shift
Register
3:1 Input Mux
RFA0
PRAVCC1
PREINI
PREINIB
PRAGND
PRAVCC2
PREINGB
PREING
PRAGNDDIG
LOIN
DCLQCP
DCLQCIN
REFVCC
TCAPP
TCAPM
CREF
REFGND
PRSCIN
VCOCT2
VCOCT1
XTALWARP
OSCVCC
OSCGND
XTALBASE
XTALEMIT
CPGITR
ADAPT
CPGT
MNCPGND
MAINVCC
MAINGND
AOCDRIVE
26 MHz
Internal
Reference
& Bias
S/H
VA
C
VACBYP
NVCC
NGND
QVCC
QGND
SERIALVCC
SERIALGND
SRD
RXACQ
STD
TXCLK/SCK
RSTB
TXE/TXKEY
RXCLK
RXFS/SFS
TSLOT
TSLOTB
TCLK
TCLKB
1.0, 2.4 or 2.6 MHz
CLKGENIN
Clock
Gen.
OUTI
OUTIB
OUTQ
OUTQB
DMCS
VBLIN
ASW
VCNTO
SPII
SPICLK
CEX
Mixer & Preamp
Current
Output
Enable
D or A
IF
Control
Channel
AFC
SPII
SPICLK
CEX
Addressable Shift
Register
8 Bit
D/A
Accumulator #3
Accumulator #2
Accumulator #1
From
PtD
IREF
3
5
Test
Multiplex
(2 Outputs)
+1/
+2/
+3/
+4
Phase Detector/
Charge Pump
+N
400 KHz
Reference
8
62
49
22
62
13.0 - 16.8 MHz or
26.0 - 33.6 MHz
From
PtA
From
PtA
PtD
MUX
From PtB
Recombination
Logic
2
3
From
PtD
Programmable
Divider
From
PtC
TXE/
TXKEY
Control
Logic
8 6
+1/
+2
+1/+2/
+3/+4
16
6
SPI
REG
8
8 Bit
Counter
8 Bit
D/A
8 Bit
Reg
6 Bit
D/A
5 Bit
D/A
5 Bit
Reg
6 Bit
Reg
6
8
5
Super Filter
CLKGENIN
MUX
Dual Mode
Charge Pump
Wideb and
Charge Pump
Reference
Oscillator
Startup
9 Bit
D/A
6 Bit
D/A
Phase
Detector
2
SPI
Control
Adapt
SPI
Control
26 MHz
2
PtC 200 kHz
4
6
PtA
PtB
+10/
+26
4
26 MHz
+13/ +17/
+26/ +34
+65/ +84/
+130/ +168
3 Bit
Counter
+7/
+14/
+21/
+28
5
8
TBD Order
Passive Filter
Addressable Shift
Register
Comb
Filter
8 Bit
D/A
Sw. Cap
Filter
Cont.
Time
Filter
Comb
Filter
8 Bit
D/A
Sw. Cap
Filter
Cont.
Time
Filter
Clock
Generation &
Control Logic
Receive
Data Register
Transmit
Data Register
13.0 or 16.8 MHz
IREF
10 Bit, or 8 Bit
Cyclic A/D
8 X 6
Cosine
Lookup
6
3
Third Order
Passive Filter
Accumulator #3
Accumulator #2
Accumulator #1
24
8
Look-Up
ROM
Programmable
Divider
6
Recombination
Logic
AGC
AGCGND
AGCVCC
BBEGND
BBEVCC
DCLICIN
DCLICP
DMKGND
DMKVCC
DMKGNDDIG
DMKVCCDIG
Loop
Filter
Tark
Circuit
LONCGND
LONCVCC
GPO3
GPO2
GPO1
TESTD
TM
TEST2
TEST1
PLLCP
PLLBASE
PLLEMIT
CLKOUT
PLLCPVCC
REFPLLGND
REFPLL
VCC
CLKSEL
OSCENB
DETSW
SA
TDET
TXKEYOUT
SEGND
SFOUT
SEBYP
SFVCC
B
16
B
DQ
dk
4.333 MHz
TX DATA Buffer
DO
16 LSB
32
AFC_SEL
24
Fine Channel
Start
Clk
24
Figure 1. MC13760 Detailed Block Diagram
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述
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