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參數(shù)資料
| 型號： | MC13226VR2 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PBGA99 |
| 封裝： | 9.50 X 9.50 MM, 1.20 MM HEIGHT, ROHS COMPLIANT, LGA-99 |
| 文件頁數(shù)： | 39/54頁 |
| 文件大?。?/td> | 490K |
| 代理商： | MC13226VR2 |
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MC1322x Technical Data, Rev. 1.3
44
Freescale Semiconductor
7.10
SPI Timing
Figure 12. SPI Timing Diagram
Table 18 describes the timing requirements for the SPI system.
Table 17. Timer Input Timing
(VBATT, LREG_BK_FB = 3.3 V, TA = 25 °C, fref = 24 MHz, unless otherwise noted.)
Parameter
Symbol
Min
Max
Unit
External clock frequency
dc
peripheral_bus_clk/3
MHz
External clock period
>3
—
tcyc
Input capture pulse width
>3
—
tcyc
Table 18. SPI Timing
Parameter
Symbol
Min
Typical
Max
Unit
Master SPI_SCK Period
t
CYC
peripheral_
Clk*2
38
peripheral_
Clk *256
ns
Slave SPI_SCK Period
t
CYC
10
ns
Slave SPI_SS Setup Time
t
SS_SU
10
ns
Slave SPI_SS Hold Time
t
SS_H
10
ns
Slave SPI_MOSI Setup Time
t
SI_SU
10
ns
Slave SPI_MOSI Hold Time
t
SI_H
10
ns
Master SPI_MISO Setup Time
t
MI_SU
20
ns
Master SPI_MISO Hold Time
t
MI_H
0ns
Master SPI_MOSI Output Time
t
MO
5ns
Slave SPI_MISO Output Time (with 15 pf load)
t
SO
20
ns
SPI_SCK
SPI_MOSI (slave in)
SPI_SS (slave in)
SPI_MISO (master in)
t
XX_SU
t
XX_H
t
CYC
t
SS_SU
t
SS_H
t
MO,tSO
SPI_MOSI (master out)
SPI_MISO (slave out)
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PDF描述 |
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