參數(shù)資料
型號(hào)： MC13214
廠(chǎng)商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： SPECIALTY MICROPROCESSOR CIRCUIT, BGA71
封裝： 9 X 9 MM, 1 MM HEIGHT, ROHS COMPLIANT, LGA-71
文件頁(yè)數(shù)： 52/366頁(yè)
文件大?。?/td> 3955K
代理商： MC13214
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)當(dāng)前第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)第194頁(yè)第195頁(yè)第196頁(yè)第197頁(yè)第198頁(yè)第199頁(yè)第200頁(yè)第201頁(yè)第202頁(yè)第203頁(yè)第204頁(yè)第205頁(yè)第206頁(yè)第207頁(yè)第208頁(yè)第209頁(yè)第210頁(yè)第211頁(yè)第212頁(yè)第213頁(yè)第214頁(yè)第215頁(yè)第216頁(yè)第217頁(yè)第218頁(yè)第219頁(yè)第220頁(yè)第221頁(yè)第222頁(yè)第223頁(yè)第224頁(yè)第225頁(yè)第226頁(yè)第227頁(yè)第228頁(yè)第229頁(yè)第230頁(yè)第231頁(yè)第232頁(yè)第233頁(yè)第234頁(yè)第235頁(yè)第236頁(yè)第237頁(yè)第238頁(yè)第239頁(yè)第240頁(yè)第241頁(yè)第242頁(yè)第243頁(yè)第244頁(yè)第245頁(yè)第246頁(yè)第247頁(yè)第248頁(yè)第249頁(yè)第250頁(yè)第251頁(yè)第252頁(yè)第253頁(yè)第254頁(yè)第255頁(yè)第256頁(yè)第257頁(yè)第258頁(yè)第259頁(yè)第260頁(yè)第261頁(yè)第262頁(yè)第263頁(yè)第264頁(yè)第265頁(yè)第266頁(yè)第267頁(yè)第268頁(yè)第269頁(yè)第270頁(yè)第271頁(yè)第272頁(yè)第273頁(yè)第274頁(yè)第275頁(yè)第276頁(yè)第277頁(yè)第278頁(yè)第279頁(yè)第280頁(yè)第281頁(yè)第282頁(yè)第283頁(yè)第284頁(yè)第285頁(yè)第286頁(yè)第287頁(yè)第288頁(yè)第289頁(yè)第290頁(yè)第291頁(yè)第292頁(yè)第293頁(yè)第294頁(yè)第295頁(yè)第296頁(yè)第297頁(yè)第298頁(yè)第299頁(yè)第300頁(yè)第301頁(yè)第302頁(yè)第303頁(yè)第304頁(yè)第305頁(yè)第306頁(yè)第307頁(yè)第308頁(yè)第309頁(yè)第310頁(yè)第311頁(yè)第312頁(yè)第313頁(yè)第314頁(yè)第315頁(yè)第316頁(yè)第317頁(yè)第318頁(yè)第319頁(yè)第320頁(yè)第321頁(yè)第322頁(yè)第323頁(yè)第324頁(yè)第325頁(yè)第326頁(yè)第327頁(yè)第328頁(yè)第329頁(yè)第330頁(yè)第331頁(yè)第332頁(yè)第333頁(yè)第334頁(yè)第335頁(yè)第336頁(yè)第337頁(yè)第338頁(yè)第339頁(yè)第340頁(yè)第341頁(yè)第342頁(yè)第343頁(yè)第344頁(yè)第345頁(yè)第346頁(yè)第347頁(yè)第348頁(yè)第349頁(yè)第350頁(yè)第351頁(yè)第352頁(yè)第353頁(yè)第354頁(yè)第355頁(yè)第356頁(yè)第357頁(yè)第358頁(yè)第359頁(yè)第360頁(yè)第361頁(yè)第362頁(yè)第363頁(yè)第364頁(yè)第365頁(yè)第366頁(yè)
Modem Modes of Operation
MC1321x Reference Manual, Rev. 1.0
Freescale Semiconductor
7-9
d) use_strm_mode = 0.
4. tx_sent_mask, Control_A Register 06, Bit 9 is programmed to “1” to enable an interrupt request
when the TX packet has been sent.
5. The MCU loads the value of the number of data bytes plus two (for FCS) into tx_pkt_length[6:0]
TX_Pkt_Ctl Register 03, Bits 6 - 0.
6. The MCU then pre-loads the number of actual data bytes into tx_pkt_ram[15:0] TX_Pkt_RAM
register 02 with a recursive SPI write. An odd number of data bytes requires stuffing a dummy byte
due to the 16-bit SPI data format.
7. Transceiver sequence is programmed to xcvr_seq[1:0] = 0x3 for transmit.
8. RXTXEN must be asserted and held high.
9. When the packet is successfully transmitted, tx_sent_irq reports the completion of packet
transmission, where a “1” indicates a complete status. Also, an interrupt is generated due to the
valid status.
10. In response of the interrupt request from the MC1321x, the microcontroller reads the status to clear
the interrupt and check successful transmission.
7.3.4
Stream Mode Data Transfer TX and RX Operation
Stream Mode does not use the onboard buffer RAMs and presents the data to the SPI buffer on a
word-by-word basis. The Idle Mode is the condition from which RX and TX modes are initiated. In Stream
Mode, control bits tx_strm, rx_strm and use_strm_mode control transition to RX or TX modes
(xcvr_seq[1:0] must equal 00 for Idle). However, the RXTXEN signal must also be high for the transition
to occur and if the Event Timer is enabled, the transition will be synchronized to the TC2_Prime compare
event. Once Receive or Transmit is entered, the MC1321x will transition back to the Idle Mode upon
completion of the selected operation.
The selected mode is controlled by:
1. For Stream Mode, xcvr_seq[1:0] field must be cleared to zero.
2. use_strm_mode, Control_B Register 07, Bit 5 - Set to “1” first to enable Stream Mode.
3. rx_strm, Control_A Register 06, Bit 11, and tx_strm, Control_A Register 06, Bit 12 - These bits
are used to initiate RX or TX operation once Stream Mode is selected.
a) rx_strm is set to 1 to initiate a RX sequence (tx_strm stays at 0).
b) tx_strm is set to 1 to initiate a TX sequence (rx_strm stays at 0).
4. RXTXEN signal - The transition to any other active mode from Idle will not occur unless
RXTXEN is asserted high. This signal may be held high to allow the transitions to occur based on
SPI programming and/or Event Timer activity.
5. tmr_trig_en, Control_A Register 06, Bit 7 - When tmr_trig_en is set to “1”, the transition to the
selected active mode will be based on a tc2_prime[15:0] compare function as described in the
Event Timer section. For Stream Mode, tc2_prime[15:0] takes the place of tmr_cmp2[23:0]
making the compare function based on a 16-bit value as opposed to a 24-bit value. Also,
tc2_prime[15:0] uses the tmr2_irq when the transceiver is in Stream Mode. When tmr_trig_en is
cleared to “0”, the transition to the selected active mode is based only on programming of the
stream control bits. For both cases, RXTXEN must be set high.
相關(guān)PDF資料
PDF描述
MC14000UBCPD 4000/14000/40000 SERIES, DUAL 3-INPUT NOR GATE, PDIP14
MC14174BCPD 4000/14000/40000 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDIP16
MC14174BD 4000/14000/40000 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO16
MC145011DW SPECIALTY ANALOG CIRCUIT, PDSO16
MC2850-13-1 0.1 A, 2 ELEMENT, SILICON, SIGNAL DIODE
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC13214R2 制造商:Freescale Semiconductor 功能描述:IC TXRX RF 2.4GHZ Z-STACK 71-LGA
MC1321X 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:
MC1321X_09 制造商:FREESCALE 制造商全稱(chēng):Freescale Semiconductor, Inc 功能描述:ZigBee?- Compliant Platform - 2.4 GHz Low Power Transceiver for the IEEE? 802.15.4 Standard plus Microcontroller
MC13224V 功能描述:射頻收發(fā)器 PIP 802.15.4 2.4G IND RoHS:否 制造商:Atmel 頻率范圍:2322 MHz to 2527 MHz 最大數(shù)據(jù)速率:2000 Kbps 調(diào)制格式:OQPSK 輸出功率:4 dBm 類(lèi)型: 工作電源電壓:1.8 V to 3.6 V 最大工作溫度:+ 85 C 接口類(lèi)型:SPI 封裝 / 箱體:QFN-32 封裝:Tray
MC13224V 制造商:Freescale Semiconductor 功能描述:; Controller Family/Series:(ARM7); Memor
發(fā)布緊急采購(gòu)，3分鐘左右您將得到回復(fù)。

采購(gòu)需求

(若只采購(gòu)一條型號(hào)，填寫(xiě)一行即可)

發(fā)布成功！您可以繼續(xù)發(fā)布采購(gòu)。也可以進(jìn)入我的后臺(tái)，查看報(bào)價(jià)

發(fā)布成功！您可以繼續(xù)發(fā)布采購(gòu)。也可以進(jìn)入我的后臺(tái)，查看報(bào)價(jià)

*型號(hào) *數(shù)量 廠(chǎng)商 批號(hào) 封裝
添加更多采購(gòu)

我的聯(lián)系方式

*
*
*