參數(shù)資料
型號: MC10H601
廠商: ON SEMICONDUCTOR
英文描述: 9-Bit ECL/TTL Translator
中文描述: 9位ECL / TTL電翻譯
文件頁數(shù): 1/4頁
文件大?。?/td> 81K
代理商: MC10H601
PIN NAMES
PIN
FUNCTION
GND
VCCE
VCCT
VEE
D0–D8
Q0–Q8
OEECL
OETTL
TTL Ground (0 V)
ECL VCC (0 V)
TTL Supply (+5.0 V)
ECL Supply (–5.2/–4.5 V)
Data Inputs (ECL)
Data Outputs (TTL)
3–State Control (ECL)
3–State Control (TTL)
FN SUFFIX
28–LEAD PLASTIC PLCC PACKAGE
CASE 776–02
OEECL
L
L
H
X
OETTL
L
L
X
H
D
L
H
X
X
Q
L
H
Z
Z
TRUTH TABLE
Q4
5
6
7
8
9
10
11
25
24
23
22
21
20
19
Q3
VCCT
Q2
GND
Q1
Q0
VCCE
D8
D7
D6
D5
D4
D3
26
27
28
2
3
4
18
17
16
14
13
12
15
Q5 GND VCCTQ6 GND Q7
Q8
OETTL NC OEECL VEED0
D1
D2
Figure 1. 28–Lead Pinout
(Top View)
SEMICONDUCTOR TECHNICAL DATA
2–1
REV 7
Motorola, Inc. 1997
10/97
The MC10H/100H601 is a 9–bit, dual supply ECL to TTL translator.
Devices in the Motorola 9–bit translator series utilize the 28–lead PLCC for
optimal power pinning, signal flow–through and electrical performance.
The devices feature a 48 mA TTL output stage, and AC performance is
specified into both a 50 pF and 200 pF load capacitance. For the 3–state
output disable, both ECL and TTL control inputs are provided, allowing
maximum design flexibility.
The 10H version is compatible with MECL 10H ECL logic levels. The
100H version is compatible with 100K levels.
9–Bit Ideal for Byte–Parity Applications
3–State TTL Outputs
Flow–Through Configuration
Extra TTL and ECL Power Pins to Minimize Switching Noise
ECL and TTL 3–State Control Inputs
Dual Supply
4.8 ns Max Delay into 50 pF, 9.6 ns into 200 pF (all outputs switching)
PNP TTL Inputs for Low Loading
Figure 2. Logic Diagram
OEECL
OETTL
D0
D1
D2
D3
D4
D5
D6
D7
D8
Q0
Q1
Q2
Q3
Q4
Q5
Q6
Q7
Q8
ECL
TTL
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PDF描述
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MC10H602 9-Bit Latch TTL/ECL Translator
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參數(shù)描述
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