參數(shù)資料
型號(hào)： MC10E131FN
廠商： MOTOROLA INC
元件分類： 通用總線功能
英文描述： 4-BIT D FLIP-FLOP
中文描述： 10E SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PQCC28
封裝： PLASTIC, LCC-28
文件頁(yè)數(shù)： 1/4頁(yè)
文件大小： 104K
代理商： MC10E131FN
5
6
7
8
9
10
11
Q3
Q3
VCCO
R2
CE2
D2
R3
LOGIC DIAGRAM
CE3
D3
S12
VEE
CC
S03
D0
26
27
28
2
3
4
25
24
23
22
21
20
19
18
17
16
15
14
13
12
Q2
Q2
VCC
Q1
Q1
Q0
Q0
CE0
R0
D1
CE1
R1
NC
VCCO
D3
CE3
R3
D2
CE2
R2
S03
S12
CC
R1
CE1
D1
R0
CE0
D0
Q3
Q3
Q2
Q2
Q1
Q1
Q0
Q0
S
D
Q
Q
R
S
D
Q
Q
R
R
D
Q
Q
S
R
D
Q
Q
S
1
Pinout: 28-Lead PLCC
(Top View)
* All VCC and VCCO pins are tied together on the die.
SEMICONDUCTOR TECHNICAL DATA
2–1
REV 3
Motorola, Inc. 1996
7/96
The MC10E/100E131 is a quad master-slave D-type flip-flop with
differential outputs. Each flip-flop may be clocked separately by holding
Common Clock (CC) LOW and using the Clock Enable (CE) inputs for
clocking. Common clocking is achieved by holding the CE inputs LOW
and using CC to clock all four flip-flops. In this case, the CE inputs perform
the function of controlling the common clock, to each flip-flop.
Individual asynchronous resets are provided (R). Asynchronous set
controls (S) are ganged together in pairs, with the pairing chosen to
reflect physical chip symmetry.
Data enters the master when both CC and CE are LOW, and transfers
to the slave when either CC or CE (or both) go HIGH.
1100MHz Min. Toggle Frequency
Differential Outputs
Individual and Common Clocks
Individual Resets (asynchronous)
Paired Sets (asynchronous)
Extended 100E VEE Range of – 4.2V to – 5.46V
75k
Input Pulldown Resistors
PIN NAMES
Pin
Function
D0– D3
CE0– CE3
R0– R3
CC
S03, S12
Q0– Q3
Q0– Q3
Data Inputs
Clock Enables (Individual)
Resets
Common Clock
Sets (paired)
True Outputs
Inverting Outputs
4-BIT
D FLIP-FLOP
FN SUFFIX
PLASTIC PACKAGE
CASE 776-02
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PDF描述
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參數(shù)描述
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