VBBO 17 18 16 15 14 13 12 4 3 5 678 9 Q0 11 10 SEL0
參數(shù)資料
型號： MC100EP56DTR2G
廠商： ON Semiconductor
文件頁數(shù)： 4/11頁
文件大小： 0K
描述： IC MUX DUAL 2:1 DIFF 5V 20-TSSOP
標準包裝： 2,500
系列： 100EP
類型： 差分數(shù)字多路復(fù)用器
電路： 2 x 2:1
獨立電路： 1
電壓電源： 雙電源
電源電壓： 3 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 20-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 20-TSSOP
包裝： 帶卷 (TR)
MC10EP56, MC100EP56
http://onsemi.com
2
D0b
D1a
VBBO
17
18
16
15
14
13
12
4
3
5
678
9
Q0
11
10
SEL0
SEL1 VCC
Q1
VEE
D0a
19
20
2
1
VCC
Q0
D1a
D0a
COM_SEL
VBB1
D1b
10
1
0
Table 1. PIN DESCRIPTION
PIN
D0a* D1a*
ECL Input Data a Invert
FUNCTION
ECL Input Data a
D0b* D1b*
ECL Input Data b Invert
ECL Input Data b
SEL0* SEL1*
COM_SEL*
ECL Common Select Input
ECL Indiv. Select Input
VBB0, VBB1
Q0 Q1
ECL True Outputs
Output Reference Voltage
Q0 Q1
ECL Inverted Outputs
VCC
Positive Supply
VEE
Negative Supply
SEL0
X
L
H
Table 2. TRUTH TABLE
Q0,
Q0
a
b
a
SEL1
X
L
H
L
COM_SEL
H
L
Q1,
Q1
a
b
a
b
Warning: All VCC and VEE pins must be externally connected
to Power Supply to guarantee proper operation.
Figure 1. 20Lead Package (Top View) and Logic Diagram
* Pins will default LOW when left open.
EP
Exposed Pad
1
2
3
4
5
15
14
13
12
11
67
8
9
10
20
19
18
17
16
Figure 1. QFN20 Pinout (Top View)
Q0
SEL0
COM_SEL
D0a
Q0
VCC
SEL1
VCC
Q1
VEE
D0b
D1a
D0a
VBB0
D1a
VBB1 D1b D1b
Exposed Pad
NOTE: The Exposed Pad (EP) on package bottom must be attached to a heatsinking conduit.
The Exposed Pad may only be electrically connected to VEE.
MC10/100EP56
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