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參數(shù)資料
| 型號： | MC08GT16CBE |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDIP42 |
| 封裝： | ROHS COMPLIANT, SHRINK, PLASTIC, DIP-42 |
| 文件頁數(shù)： | 76/292頁 |
| 文件大小： | 3759K |
| 代理商： | MC08GT16CBE |
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I/O Registers
MC68HC908GT16 MC68HC908GT8 MC68HC08GT16 Data Sheet, Rev. 5.0
Freescale Semiconductor
167
14.8.3 ESCI Control Register 3
ESCI control register 3 (SCC3):
Stores the ninth ESCI data bit received and the ninth ESCI data bit to be transmitted.
Enables these interrupts:
–
Receiver overrun
–
Noise error
–
Framing error
–
Parity error
R8 — Received Bit 8
When the ESCI is receiving 9-bit characters, R8 is the read-only ninth bit (bit 8) of the received
character. R8 is received at the same time that the SCDR receives the other 8 bits.
When the ESCI is receiving 8-bit characters, R8 is a copy of the eighth bit (bit 7). Reset has no effect
on the R8 bit.
T8 — Transmitted Bit 8
When the ESCI is transmitting 9-bit characters, T8 is the read/write ninth bit (bit 8) of the transmitted
character. T8 is loaded into the transmit shift register at the same time that the SCDR is loaded into
the transmit shift register. Reset clears the T8 bit.
ORIE — Receiver Overrun Interrupt Enable Bit
This read/write bit enables ESCI error CPU interrupt requests generated by the receiver overrun bit,
OR. Reset clears ORIE.
1 = ESCI error CPU interrupt requests from OR bit enabled
0 = ESCI error CPU interrupt requests from OR bit disabled
NEIE — Receiver Noise Error Interrupt Enable Bit
This read/write bit enables ESCI error CPU interrupt requests generated by the noise error bit, NE.
Reset clears NEIE.
1 = ESCI error CPU interrupt requests from NE bit enabled
0 = ESCI error CPU interrupt requests from NE bit disabled
FEIE — Receiver Framing Error Interrupt Enable Bit
This read/write bit enables ESCI error CPU interrupt requests generated by the framing error bit, FE.
Reset clears FEIE.
1 = ESCI error CPU interrupt requests from FE bit enabled
0 = ESCI error CPU interrupt requests from FE bit disabled
PEIE — Receiver Parity Error Interrupt Enable Bit
This read/write bit enables ESCI receiver CPU interrupt requests generated by the parity error bit, PE.
Reset clears PEIE.
1 = ESCI error CPU interrupt requests from PE bit enabled
0 = ESCI error CPU interrupt requests from PE bit disabled
Address:
$0015
Bit 7
654321
Bit 0
Read:
R8
T8
R
ORIE
NEIE
FEIE
PEIE
Write:
Reset:
U
0000000
= Unimplemented
R
= Reserved
U = Unaffected
Figure 14-12. ESCI Control Register 3 (SCC3)
相關PDF資料 |
PDF描述 |
|---|---|
| MC100E107FNR2 | 100E SERIES, 5 2-INPUT XOR/XNOR GATE, PQCC28 |
| MC100ES6210AC | Low Voltage 2.5/3.3 V Differential ECL/PECL/HSTL Fanout Buffer |
| MC100LVEL58MNR4 | 100LVEL SERIES, 2 LINE TO 1 LINE MULTIPLEXER, COMPLEMENTARY OUTPUT, PDSO8 |
| MC100 | 1 CHANNEL TRANSISTOR OUTPUT OPTOCOUPLER |
| MC10E336FNR2 | 10E SERIES, 3-BIT REGISTERED TRANSCEIVER, INVERTED OUTPUT, PQCC28 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC08XS6421BEK | 功能描述:IC SWITCH HIGH SIDE 32SOIC 制造商:nxp usa inc. 系列:- 包裝:管件 零件狀態(tài):在售 開關類型:通用 輸出數(shù):4 比率 - 輸入:輸出:1:1 輸出配置:高端 輸出類型:N 通道 接口:SPI 電壓 - 負載:7 V ~ 18 V 電壓 - 電源（Vcc/Vdd）:4.5 V ~ 5.5 V 電流 - 輸出（最大值）:5.5A，11A 導通電阻（典型值）:8 毫歐，21 毫歐 輸入類型:- 特性:- 故障保護:限流（固定），開路負載檢測，超溫 工作溫度:-40°C ~ 125°C（TA） 封裝/外殼:32-SSOP（0.295"，7.50mm 寬）裸露焊盤 供應商器件封裝:32-SOIC EP 標準包裝:42 |
| MC0907X7R104JS050 | 制造商: 功能描述: 制造商:undefined 功能描述: |
| MC0908-G | 制造商:SPC Multicomp 功能描述:GUARD PLASTIC 80MM 制造商:SPC Multicomp 功能描述:GUARD, PLASTIC, 80MM |
| MC090D050U/D+ | 制造商:UNBRANDED 功能描述:ADAPTOR UNREG EURO 9VDC 500MA |
| MC090D050U/D+ | 制造商:Pro-Signal 功能描述:ADAPTOR UNREG EURO 9VDC 500MA |
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