參數(shù)資料
型號(hào)： MB95F262KPF-G-SNE2
廠商： Fujitsu Semiconductor America Inc
文件頁數(shù)： 13/87頁
文件大?。?/td> 0K
描述： IC MCU 8BIT 8KB FLASH 20SOP
標(biāo)準(zhǔn)包裝： 1,400
系列： 8FX MB95260H
核心處理器： F²MC-8FX
芯體尺寸： 8-位
速度： 16MHz
連通性： LIN，SIO，UART/USART
外圍設(shè)備： LVD，POR，PWM，WDT
輸入/輸出數(shù)： 16
程序存儲(chǔ)器容量： 8KB（8K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 240 x 8
電壓 - 電源 (Vcc/Vdd)： 2.4 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 6x8/10b
振蕩器型： 外部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 托盤
其它名稱： 865-1209
23
32054F–AVR32–09/09
AT32AP7002
6.3
Programming Model
6.3.1
Register file configuration
The AVR32B architecture specifies that the exception contexts may have a different number of
shadowed registers in different implementations. Figure 6-3 on page 23 shows the model used
in AVR32 AP.
Figure 6-3.
The AVR32 AP Register File
6.3.2
Status register configuration
The Status Register (SR) is splitted into two halfwords, one upper and one lower, see Figure 6-4
on page 23 and Figure 6-5 on page 24. The lower word contains the C, Z, N, V and Q condition
code flags and the R, T and L bits, while the upper halfword contains information about the
mode and state the processor executes in. Refer to the AVR32 Architecture Manual for details.
Figure 6-4.
The Status Register High Halfword
Application
Bit 0
Supervisor
Bit 31
PC
SR
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
Bit 0
Bit 31
PC
SR
R12
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R11
R9
R10
R8
R3
R1
R2
R0
RSR_INT0
SR
RSR_EX
SR
SP_APP
SP_SYS
RSR_NMI
SR
R12
R11
R9
R10
R8
Bit 0
Bit 31
PC
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
Bit 0
Bit 31
PC
FINTPC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
Bit 0
Bit 31
PC
LR_INT3
R12_INT3
R11_INT3
R9_INT3
R10_INT3
R8_INT3
SP_SYS
R12
R11
R9
R10
R8
Bit 0
Bit 31
PC
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
SP_SYS
R12
R11
R9
R10
R8
Bit 0
Bit 31
PC
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
SP_SYS
R12
R11
R9
R10
R8
Bit 0
Bit 31
PC
INT0PC
FINTPC
INT1PC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
SP_SYS
R12
R11
R9
R10
R8
RSR_INT1
SR
RSR_INT2
SR
RSR_INT3
SR
INT0
INT1
INT2
INT3
Exception
NMI
FINTPC
SMPC
R7
R5
R6
R4
R3
R1
R2
R0
R12
R11
R9
R10
R8
LR
RSR_SUP
RAR_INT0
RAR_EX
RAR_NMI
RAR_INT1
RAR_INT2
RAR_INT3
RAR_SUP
Bit 31
0
Bit 16
Interrupt Level 0 Mask
Interrupt Level 1 Mask
Interrupt Level 3 Mask
Interrupt Level 2 Mask
1
0
1
0
Reserved
FE
I0M
GM
M1
J
D
M0
EM
I2M
DM
-
M2
LC
1
-
Initial value
Bit name
I1M
Mode Bit 0
Mode Bit 1
H
Mode Bit 2
Reserved
Debug State
-
I3M
Java State
Exception Mask
Global Interrupt Mask
Debug State Mask
Java Handle
Reserved
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PDF描述
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參數(shù)描述
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