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參數(shù)資料
| 型號(hào)： | MB95F108AMS |
| 廠商： | Fujitsu Limited |
| 英文描述： | 8-bit Proprietary Microcontrollers(8位微控制器) |
| 中文描述： | 8位微控制器專利（8位微控制器） |
| 文件頁(yè)數(shù)： | 54/72頁(yè) |
| 文件大?。?/td> | 739K |
| 代理商： | MB95F108AMS |
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MB95100AM Series
54
Sampling at the rising edge of sampling clock
*1
and enabled serial clock delay
*2
(ESCR register : SCES bit
=
0, ECCR register : SCDE bit
=
1)
(Vcc
=
5.0 V
±
10
%
, AVss
=
Vss
=
0.0 V, T
A
=
40
°
C to
+
85
°
C)
*1 : Provide switch function whether sampling of reception data is performed at rising edge or falling edge of the
serial clock.
*2 : Serial clock delay function is used to delay half clock for the output signal of serial clock.
*3 : Refer to “ (2) Source Clock/Machine Clock” for t
MCLK
.
Parameter
Sym-
bol
Pin name
Conditions
Value
Unit
Min
Max
+
95
4 t
MCLK
*
3
Serial clock cycle time
SCK
↑
→
SOT delay time
Valid SIN
→
SCK
↓
SCK
↓
→
valid SIN hold time
SOT
→
SCK
↓
delay time
t
SCYC
SCK
Internal clock
operation output pin :
C
L
=
80 pF
+
1 TTL.
5 t
MCLK
*
3
95
t
MCLK
*
3
+
190
0
ns
t
SHOVI
SCK, SOT
ns
t
IVSLI
SCK, SIN
ns
t
SLIXI
SCK, SIN
ns
t
SOVLI
SCK, SOT
ns
SCK
SOT
SIN
2.4 V
0.8 V
0.8 V
t
SHOVI
2.4 V
0.8 V
0.8 V
CC
0.2 V
CC
0.8 V
CC
0.2 V
CC
2.4 V
0.8 V
t
SCYC
t
SOVLI
t
IVSLI
t
SLIXI
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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