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參數(shù)資料
| 型號： | MB90F583CAPFV |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-bit Proprietary Microcontroller |
| 中文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 33/124頁 |
| 文件大小： | 2639K |
| 代理商： | MB90F583CAPFV |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁當(dāng)前第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁
MB90580C Series
33
I
INTERRUPT FACTORS, INTERRUPT VECTORS, INTERRUPT CONTROL REGISTER
: Indicates that the interrupt request flag is cleared by the EI
2
OS interrupt clear signal (stop request present).
: Indicates that the interrupt request flag is cleared by the EI
2
OS interrupt clear signal.
×
: Indicates that the interrupt request flag is not cleared by the EI
2
OS interrupt clear signal.
Interrupt source
EI
2
OS
support
Interrupt vector
Interrupt control
register
Priority
No.
Address
ICR
Address
Reset
INT9 instruction
Exception
A/D converter
Timebase timer
DTP0 (external interrupt #0) /UART3 reception
complete
DTP1 (external interrupt #1) /UART4 reception
complete
DTP2 (external interrupt #2) /UART3 transmission
complete
×
×
×
#08
#09
#10
#11
#12
FFFFDC
H
FFFFD8
H
FFFFD4
H
FFFFD0
H
FFFFCC
H
High
ICR00
0000B0
H
×
#13
FFFFC8
H
ICR01
0000B1
H
#14
FFFFC4
H
#15
FFFFC0
H
ICR02
0000B2
H
DTP3 (external interrupt #3) /UART4 transmission
complete
#16
FFFFBC
H
DTP4 to 7 (external interrupt #4 to #7)
Output compare (ch.1) match (I/O timer)
UART2 reception complete
UART1 reception complete
Input capture (ch.3) include (I/O timer)
Input capture (ch.2) include (I/O timer)
Input capture (ch.1) include (I/O timer)
Input capture (ch.0) include (I/O timer)
8/16 bit PPG0 counter borrow
16 bit reload timer 2 to 0
Clock prescaler
Output compare (ch.0) match (I/O timer)
UART2
transmission complete
PWC timer measurement complete / over flow
UART1
transmission complete
16-bit free run timer (
I/O timer
)
over flow
UART0
transmission complete
8/16 bit PPG1 counter borrow
IEBus reception complete
IEBus transmission start
UART0 reception complete
Flash memory status
Delayed interrupt
#17
#18
#19
#20
#21
#22
#23
#24
#25
#26
#27
#28
#29
#30
#31
#32
#33
#34
#35
#37
#39
#41
#42
FFFFB8
H
FFFFB4
H
FFFFB0
H
FFFFAC
H
FFFFA8
H
FFFFA4
H
FFFFA0
H
FFFF9C
H
FFFF98
H
FFFF94
H
FFFF90
H
FFFF8C
H
FFFF88
H
FFFF84
H
FFFF80
H
FFFF7C
H
FFFF78
H
FFFF74
H
FFFF70
H
FFFF68
H
FFFF60
H
FFFF58
H
FFFF54
H
ICR03
0000B3
H
ICR04
0000B4
H
ICR05
0000B5
H
ICR06
0000B6
H
×
ICR07
0000B7
H
×
ICR08
0000B8
H
ICR09
0000B9
H
ICR10
0000BA
H
ICR11
0000BB
H
×
ICR12
ICR13
ICR14
0000BC
H
0000BD
H
0000BE
H
×
×
ICR15
0000BF
H
Low
相關(guān)PDF資料 |
PDF描述 |
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