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參數(shù)資料
| 型號： | MB90F553APFV |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Octal Bus Transceivers And Registers With 3-State Outputs 24-CFP -55 to 125 |
| 中文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | PLASTIC, LQFP-100 |
| 文件頁數(shù)： | 38/58頁 |
| 文件大?。?/td> | 695K |
| 代理商： | MB90F553APFV |
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MB90550A/550B Series
38
(5) Bus Read Timing
(V
CC
=
5.0 V
±
10%, V
SS
=
AV
SS
=
0.0 V, T
A
=
40
°
C to +85
°
C)
Value
Parameter
Symbol
Pin name
Unit
Remarks
Min.
Max.
ALE pulse width
t
LHLL
ALE
t
CP
/2
20
—
ns
Effective address
→
ALE
↓
time
t
AVLL
ALE, A23 to A16,
AD15 to AD00
t
CP
/2
20
—
ns
ALE
↓
→
address effective time
t
LLAX
ALE, AD15 to AD00
t
CP
/2
15
—
ns
Effective address
→
RD
↓
time
t
AVRL
A23 to A16,
AD15 to AD00, RD
t
CP
15
—
ns
Effective address
→
valid data
input
t
AVDV
A23 to A16,
AD15 to AD00
—
5 t
CP
/2
60
ns
RD pulse width
RD
↓
→
valid data input
RD
↑
→
data hold time
RD
↑
→
ALE
↑
time
RD
↑
→
address effective time
t
RLRH
RD
3 t
CP
/2
20
—
—
ns
t
RLDV
RD, AD15 to AD00
3 t
CP
/2
60
—
ns
t
RHDX
RD, AD15 to AD00
0
ns
t
RHLH
RD, ALE
t
CP
/2
15
t
CP
/2
10
—
ns
t
RHAX
ALE, A23 to A16
—
ns
Effective address
→
CLK
↑
time
t
AVCH
A23 to A16,
AD15 to AD00, CLK
t
CP
/2
20
—
ns
RD
↓
→
CLK
↑
time
ALE
↓
→
RD
↓
time
t
RLCH
RD, CLK
t
CP
/2
20
t
CP
/2
15
—
ns
t
LLRL
ALE, RD
—
ns
CLK
ALE
A23 to A16
AD15 to AD00
RD
t
AVCH
t
LHLL
t
AVLL
t
RLRH
t
RHAX
t
RHDX
t
RLDV
t
AVRL
t
AVDV
t
RHLH
t
RLCH
2.4 V
2.4 V
2.4 V
0.8 V
2.4 V
2.4 V
2.4 V
0.8 V
0.8 V
0.7 V
CC
0.3 V
CC
0.7 V
CC
0.3 V
CC
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
0.8 V
2.4 V
t
LLAX
t
LLRL
Bus read timing
Multiplex mode
Address
Read data
相關(guān)PDF資料 |
PDF描述 |
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