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參數(shù)資料
| 型號： | MB90553BPF |
| 廠商： | FUJITSU LTD |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Hex Schmitt-trigger Inverters 14-CDIP -55 to 125 |
| 中文描述： | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 3.35 MM HEIGHT, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 25/58頁 |
| 文件大?。?/td> | 695K |
| 代理商： | MB90553BPF |
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MB90550A/550B Series
25
(Continued)
Address
Register name
Abbreviated
register name
Read/write
Resource name
Initial value
5A
H
Control status register 0
TMCSR0
R/W
16-bit
reload timer 0
0 0 0 0 0 0 0 0
5B
H
_ _ _ _ 0 0 0 0
5C
H
16 bit timer register 0/
16 bit reload register 0
TMR0/
TMRLR0
R/W
XXXXXXXX
5D
H
XXXXXXXX
5E
H
Control status register
1
TMCSR1
R/W
16-bit
reload timer 1
0 0 0 0 0 0 0 0
5F
H
_ _ _ _ 0 0 0 0
60
H
16 bit timer register 1/
16 bit reload register 1
TMR1/
TMRLR1
R/W
XXXXXXXX
61
H
XXXXXXXX
62
H
Input capture register,
channel-0 lower bits
IPCP0
R
16-bit
I/O timer
Input capture
(ch.0 to ch.3)
XXXXXXXX
63
H
Input capture register,
channel-0 upper bits
XXXXXXXX
64
H
Input capture register,
channel-1 lower bits
IPCP1
R
XXXXXXXX
65
H
Input capture register,
channel-1 upper bits
XXXXXXXX
66
H
Input capture register,
channel-2 lower bits
IPCP2
R
XXXXXXXX
67
H
Input capture register,
channel-2 upper bits
XXXXXXXX
68
H
Input capture register,
channel-3 lower bits
IPCP3
R
XXXXXXXX
69
H
Input capture register,
channel-3 upper bits
XXXXXXXX
6A
H
Input capture control
status register
ICS01
R/W
0 0 0 0 0 0 0 0
6B
H
Input capture control
status register
ICS23
R/W
0 0 0 0 0 0 0 0
6C
H
Timer data register, lower bits
TCDT
R/W
16-bit
I/O timer
free run timer
0 0 0 0 0 0 0 0
6D
H
Timer data register, upper bits
R/W
0 0 0 0 0 0 0 0
6E
H
Timer control status register
TCCS
R/W
0 0 0 0 0 0 0 0
6F
H
ROM mirroring function
selection register
ROMM
W
ROM mirroring
function
_ _ _ _ _ _ _ 1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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