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參數(shù)資料
| 型號(hào)： | MB90480 |
| 廠商： | Fujitsu Limited |
| 英文描述： | 16-bit Proprietary Microcontroller |
| 中文描述： | 16位微控制器專(zhuān)有 |
| 文件頁(yè)數(shù)： | 100/120頁(yè) |
| 文件大?。?/td> | 1241K |
| 代理商： | MB90480 |
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MB90480/485 Series
100
(8) Hold Timing
(V
CC
=
2.7 V to 3.6 V, V
SS
=
0.0 V, T
A
=
40
°
C to
+
85
°
C)
Value
* : t
CP
is internal operating clock cycle time. Refer to “ (1) Clock Timing”.
Note : One or more cycles are required from the time the HRQ pin is read until the HAK signal changes.
(9) UART Timing
(V
CC
=
2.7 V to 3.6 V, V
SS
=
0.0 V, T
A
=
40
°
C to
+
85
°
C)
Value
*1 : C
L
is the load capacitance applied to pins for testing.
*2 : t
CP
is internal operating clock cycle time. Refer to “ (1) Clock Timing”.
Note : The above rating is in CLK synchronous mode.
Parameter
Symbol
Pin name
Conditions
Unit
Remarks
Min
Max
Pin floating
→
HAK
↓
time
HAK
↓→
pin valid time
t
XHAL
HAK
30
t
CP
*
ns
t
HAHV
HAK
t
CP
*
2 t
CP
*
ns
Parameter
Symbol
Pin
name
Conditions
Unit
Remarks
Min
Max
+
80
+
120
150
Serial clock cycle time
t
SCYC
Internal shift clock
mode output pins :
C
L
*
1
=
80 pF
+
1 TTL
8 t
CP
*
2
80
120
100
ns
SCK
↓→
SOT delay time
t
SLOV
ns
ns
f
CP
=
8 MHz
Valid SIN
→
SCK
↑
t
IVSH
ns
200
ns
f
CP
=
8 MHz
SCK
↑→
valid SIN hold time
Serial clock “H” pulse width
t
SHIX
t
CP
*
2
ns
t
SHSL
External shift clock
mode output pins :
C
L
*
1
=
80 pF
+
1 TTL
4 t
CP
*
2
ns
Serial clock “L” pulse width
t
SLSH
4 t
CP
*
2
60
ns
SCK
↓→
SOT delay time
t
SLOV
ns
200
ns
f
CP
=
8 MHz
Valid SIN
→
SCK
↑
t
IVSH
ns
120
ns
f
CP
=
8 MHz
SCK
↑→
valid SIN hold time
t
SHIX
60
ns
120
ns
f
CP
=
8 MHz
HAK
t
XHAL
t
HAHV
2.4 V
0.8 V
2.4 V
2.4 V
0.8 V
0.8 V
Pins
High-Z
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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