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參數(shù)資料
| 型號： | MB89965PFV-G-XXX |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 10 MHz, MICROCONTROLLER, PQFP64 |
| 封裝： | 10 X 10 MM, 0.50 MM PITCH, PLASTIC, LQFP-64 |
| 文件頁數(shù)： | 173/278頁 |
| 文件大?。?/td> | 1847K |
| 代理商： | MB89965PFV-G-XXX |
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232
CHAPTER 12 I2C Interface
MB89960 series
12.7 Program Example for the I2C Interface
This section gives program examples for the I2C interface.
s Program Example for the Master Transmit Mode
q Processing description
Generates serial clock rate at 100 kbit/s.
Use System Management Bus input buffer characteristic.
Set in master transmit mode.
Transmit data 64H to slave with address 19H.
The following shows the ICCR register value that results in a serial clock rate Fsck of
approximately 100 kbit/s for a source oscillation Fc of 10 MHz.
where
Finst = 10MHz / 2 / 2 = 2.5MHz
m is selected by CS4 and CS3 and
n is selected by CS2,CS1 and CS0 in ICCR register.
m x n = 5 MHz /100 KHz - 4 = 46 (approximately 6 x 8)
So ICCR register value (bit 4 to bit 0) is 01000B , and ICCR: DMBP (bit 7) is 0B.
q Coding example
IBSR
EQU
0010H
;Address of the I2C bus status register
IBCR
EQU
0011H
;Address of the I2C bus control register
ICCR
EQU
0012H
;Address of the I2C clock control register
IADR
EQU
;Address of the I2C address register
IDAR
EQU
0014H
;Address of the I2C data register
EN
EQU
ICCR:5
;Defines the I2C enable bit.
BER
EQU
IBCR:7
;Defines the bus error interrupt request flag bit.
INT
EQU
IBCR:0
;Defines the data transfer completed interrupt request flag bit.
ILR3
EQU
007EH
;Address of interrupt level setting register 3
INT_V
DSEG
ABS
;[DATA SEGMENT]
ORG
0FFEAH
IRQ8
DW
WARI
;Set interrupt vector.
INT_V
ENDS
;-----Main program---------------------------------------------------------------------------------------------------------------------------------------
CSEG
;[CODE SEGMENT]
;Stack pointer (SP) etc. are already initialized.
:
CLRI
;Disable interrupts.
SETB
EN
Enable I2C operation.
MOV
ILR3,#11111101B
;Set interrupt level (level 1).
MOV
ICCR,#028H
;Enable I2C operation and select shift clock frequency as
100KHz, use SMB interface
SETI
;and enable interrupts.
MOV
IADR,#10110010B
;Set its own specific address as B2H.
MOV
IDAR,#00110010B
;Send calling address as 19H and R/W bit as write.
MOV
IBCR,#01011110B
;Enable interrupt request flags and set as master mode with
;acknowledge enable
STA_CON
MOV
A,#01110110B
;Wait for generating START condition and first byte transfer
Fsck
2Finst
mn
4
+
×
-----------------------
=
相關(guān)PDF資料 |
PDF描述 |
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| MB89N202-PSH | 8-BIT, FLASH, 12.5 MHz, MICROCONTROLLER, PDIP32 |
| MB89F202-PSH | 8-BIT, FLASH, 12.5 MHz, MICROCONTROLLER, PDIP32 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MB89983-XXX-PFV | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
| MB8998X | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:8-bit Proprietary Microcontroller |
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