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參數資料
| 型號： | MB672xxx |
| 廠商： | Fujitsu Limited |
| 英文描述： | CMOS Gate Array |
| 中文描述： | CMOS門陣列 |
| 文件頁數： | 87/106頁 |
| 文件大?。?/td> | 1648K |
| 代理商： | MB672XXX |
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MB90670/675 Series
87
(6) Bus Read Timing
(AV
CC
= V
CC
= 2.7 V to 5.5 V, AV
SS
= V
SS
= 0.0 V, T
A
= –40
°
C to +85
°
C)
* : For t
CP
(internal operating clock cycle time), refer to “(3) Clock Timing”.
Parameter
Symbol
Pin name
Condition
Value
Unit Remarks
Min.
Max.
—
—
—
—
ALE pulse width
t
LHLL
t
LHLL
t
AVLL
t
AVLL
ALE
ALE
AD15 to AD00 V
CC
= 5.0 V ±10% 1 t
CP
*/2 – 25
AD15 to AD00 V
CC
= 3.0 V ±10% 1 t
CP
*/2 – 40
V
CC
= 5.0 V ±10% 1 t
CP
*/2 – 20
V
CC
= 3.0 V ±10% 1 t
CP
*/2 – 35
ns
ns
ns
ns
Effective address
→
ALE
↓
time
ALE
↓
→
address effec-
tive time
Effective address
→
RD
↓
time
Effective address
→
read data time
t
LLAX
AD15 to AD00
—
1 t
CP
*/2 – 15
—
ns
t
AVRL
AD15 to AD00
1 t
CP
* – 15
—
ns
t
AVDV
t
AVDV
t
RLRH
t
RLDV
t
RLDV
t
RHDX
t
RHLH
AD15 to AD00 V
CC
= 5.0 V ±10%
AD15 to AD00 V
CC
= 3.0 V ±10%
RD
AD15 to AD00 V
CC
= 5.0 V ±10%
AD15 to AD00 V
CC
= 3.0 V ±10%
AD15 to AD00
RD, ALE
RD,
A19 to A16
CLK,
A19 to A16
RD, CLK
—
—
5 t
CP
*/2 – 60
5 t
CP
*/2 – 80
—
3 t
CP
*/2 – 60
3 t
CP
*/2 – 80
—
—
ns
ns
ns
ns
ns
ns
ns
RD pulse width
—
3 t
CP
*/2 – 20
—
—
0
1 t
CP
*/2 – 15
RD
↓
→
read data time
RD
↑
→
data hold time
RD
↑
→
ALE
↑
time
RD
↑
→
address disap-
pear time
Effective address
→
CLK
↑
time
RD
↓
→
CLK
↑
time
—
t
RHAX
1 t
CP
*/2 – 10
—
ns
t
AVCH
1 t
CP
*/2 – 20
—
ns
t
RLCH
1 t
CP
*/2 – 20
—
ns
相關PDF資料 |
PDF描述 |
|---|---|
| MBP673 | 16-Bit Proprietary Microcontroller |
| MB677 | 16-Bit Proprietary Microcontroller |
| MB678 | 16-Bit Proprietary Microcontroller |
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相關代理商/技術參數 |
參數描述 |
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| MB675XXX | 制造商:FUJITSU 制造商全稱:Fujitsu Component Limited. 功能描述:CMOS Gate Array |
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