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參數(shù)資料
| 型號： | M7A3P600-1FG144 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 600000 GATES, 350 MHz, PBGA144 |
| 封裝： | 1 MM PITCH, FBGA-144 |
| 文件頁數(shù)： | 200/246頁 |
| 文件大?。?/td> | 3010K |
| 代理商： | M7A3P600-1FG144 |
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ProASIC3/E Flash Family FPGAs
v2.1
2-45
At the system level, the skew circuit can be used in applications where transmission activities on bidirectional data
lines need to be coordinated. This circuit, when selected, provides a timing margin that can prevent bus contention
and subsequent data loss and/or transmitter over-stress due to transmitter-to-transmitter current shorts. Figure 2-34
presents an example of the skew circuit implementation in a bidirectional communication system. Figure 2-35 shows
how bus contention is created, and Figure 2-36 on page 2-46 shows how it can be avoided with the skew circuit.
Figure 2-34 Example of Implementation of Skew Circuits in Bidirectional Transmission Systems Using ProASIC3 Devices
Figure 2-35 Timing Diagram (bypasses skew circuit)
Transmitter 1: ProASIC3 I/O
Transmitter 2: Generic I/O
ENABLE(t2)
EN (b1)
EN (b2)
Routing
Delay (t1)
Routing
Delay (t2)
EN (r1)
ENABLE (t1)
Skew or
Bypass
Skew
Bidirectional Data Bus
Transmitter
ENABLE/
DISABLE
EN (b1)
EN (b2)
ENABLE (r1)
Transmitter 1: ON
ENABLE (t2)
Transmitter 2: ON
ENABLE (t1)
Bus
Contention
Transmitter 1: OFF
Transmitter 2: OFF
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