Revision 13 2-43 Table 2-53 3.3 V LVTTL / 3.3 V LVCMOS Low Slew Commercial-Case Conditions: T" />
參數(shù)資料
型號(hào)： M7A3P1000-2FG484I
廠商： Microsemi SoC
文件頁(yè)數(shù)： 174/220頁(yè)
文件大?。?/td> 0K
描述： IC FPGA 1KB FLASH 1M 484-FBGA
標(biāo)準(zhǔn)包裝： 40
系列： ProASIC3
RAM 位總計(jì)： 147456
輸入/輸出數(shù)： 300
門數(shù)： 1000000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 85°C
封裝/外殼： 484-BGA
供應(yīng)商設(shè)備封裝： 484-FPBGA（23x23）
第1頁(yè)第2頁(yè)第3頁(yè)第4頁(yè)第5頁(yè)第6頁(yè)第7頁(yè)第8頁(yè)第9頁(yè)第10頁(yè)第11頁(yè)第12頁(yè)第13頁(yè)第14頁(yè)第15頁(yè)第16頁(yè)第17頁(yè)第18頁(yè)第19頁(yè)第20頁(yè)第21頁(yè)第22頁(yè)第23頁(yè)第24頁(yè)第25頁(yè)第26頁(yè)第27頁(yè)第28頁(yè)第29頁(yè)第30頁(yè)第31頁(yè)第32頁(yè)第33頁(yè)第34頁(yè)第35頁(yè)第36頁(yè)第37頁(yè)第38頁(yè)第39頁(yè)第40頁(yè)第41頁(yè)第42頁(yè)第43頁(yè)第44頁(yè)第45頁(yè)第46頁(yè)第47頁(yè)第48頁(yè)第49頁(yè)第50頁(yè)第51頁(yè)第52頁(yè)第53頁(yè)第54頁(yè)第55頁(yè)第56頁(yè)第57頁(yè)第58頁(yè)第59頁(yè)第60頁(yè)第61頁(yè)第62頁(yè)第63頁(yè)第64頁(yè)第65頁(yè)第66頁(yè)第67頁(yè)第68頁(yè)第69頁(yè)第70頁(yè)第71頁(yè)第72頁(yè)第73頁(yè)第74頁(yè)第75頁(yè)第76頁(yè)第77頁(yè)第78頁(yè)第79頁(yè)第80頁(yè)第81頁(yè)第82頁(yè)第83頁(yè)第84頁(yè)第85頁(yè)第86頁(yè)第87頁(yè)第88頁(yè)第89頁(yè)第90頁(yè)第91頁(yè)第92頁(yè)第93頁(yè)第94頁(yè)第95頁(yè)第96頁(yè)第97頁(yè)第98頁(yè)第99頁(yè)第100頁(yè)第101頁(yè)第102頁(yè)第103頁(yè)第104頁(yè)第105頁(yè)第106頁(yè)第107頁(yè)第108頁(yè)第109頁(yè)第110頁(yè)第111頁(yè)第112頁(yè)第113頁(yè)第114頁(yè)第115頁(yè)第116頁(yè)第117頁(yè)第118頁(yè)第119頁(yè)第120頁(yè)第121頁(yè)第122頁(yè)第123頁(yè)第124頁(yè)第125頁(yè)第126頁(yè)第127頁(yè)第128頁(yè)第129頁(yè)第130頁(yè)第131頁(yè)第132頁(yè)第133頁(yè)第134頁(yè)第135頁(yè)第136頁(yè)第137頁(yè)第138頁(yè)第139頁(yè)第140頁(yè)第141頁(yè)第142頁(yè)第143頁(yè)第144頁(yè)第145頁(yè)第146頁(yè)第147頁(yè)第148頁(yè)第149頁(yè)第150頁(yè)第151頁(yè)第152頁(yè)第153頁(yè)第154頁(yè)第155頁(yè)第156頁(yè)第157頁(yè)第158頁(yè)第159頁(yè)第160頁(yè)第161頁(yè)第162頁(yè)第163頁(yè)第164頁(yè)第165頁(yè)第166頁(yè)第167頁(yè)第168頁(yè)第169頁(yè)第170頁(yè)第171頁(yè)第172頁(yè)第173頁(yè)當(dāng)前第174頁(yè)第175頁(yè)第176頁(yè)第177頁(yè)第178頁(yè)第179頁(yè)第180頁(yè)第181頁(yè)第182頁(yè)第183頁(yè)第184頁(yè)第185頁(yè)第186頁(yè)第187頁(yè)第188頁(yè)第189頁(yè)第190頁(yè)第191頁(yè)第192頁(yè)第193頁(yè)第194頁(yè)第195頁(yè)第196頁(yè)第197頁(yè)第198頁(yè)第199頁(yè)第200頁(yè)第201頁(yè)第202頁(yè)第203頁(yè)第204頁(yè)第205頁(yè)第206頁(yè)第207頁(yè)第208頁(yè)第209頁(yè)第210頁(yè)第211頁(yè)第212頁(yè)第213頁(yè)第214頁(yè)第215頁(yè)第216頁(yè)第217頁(yè)第218頁(yè)第219頁(yè)第220頁(yè)
ProASIC3 Flash Family FPGAs
Revision 13
2-43
Table 2-53 3.3 V LVTTL / 3.3 V LVCMOS Low Slew
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 3.0 V
Applicable to Standard Plus I/O Banks
Drive
Strength
Equiv.
Software
Default
Drive
Strength
Option1
Speed
Grade
tDOUT
tDP
tDIN tPY tEOUT tZL
tZH
tLZ
tHZ
tZLS
tZHS Units
100 A
2 mA
Std.
0.60
14.97 0.04 1.52 0.43 14.97 12.79 3.52 3.41 18.36 16.18
ns
–1
0.51
12.73 0.04 1.29 0.36 12.73 10.88 2.99 2.90 15.62 13.77
ns
–2
0.45
11.18 0.03 1.14 0.32 11.18 9.55 2.63 2.55 13.71 12.08
ns
100 A
4 mA
Std.
0.60
10.36 0.04 1.52 0.43 10.36 8.93 3.99 4.24 13.75 12.33
ns
–1
0.51
8.81 0.04 1.29 0.36
8.81
7.60 3.39 3.60 11.70 10.49
ns
–2
0.45
7.74 0.03 1.14 0.32
7.74
6.67 2.98 3.16 10.27 9.21
ns
100 A
6 mA
Std.
0.60
10.36 0.04 1.52 0.43 10.36 8.93 3.99 4.24 13.75 12.33
ns
–1
0.51
8.81 0.04 1.29 0.36
8.81
7.60 3.39 3.60 11.70 10.49
ns
–2
0.45
7.74 0.03 1.14 0.32
7.74
6.67 2.98 3.16 10.27 9.21
ns
100 A
8 mA
Std.
0.60
7.81 0.04 1.52 0.43
7.81
6.85 4.32 4.76 11.20 10.24
ns
–1
0.51
6.64 0.04 1.29 0.36
6.64
5.82 3.67 4.05 9.53
8.71
ns
–2
0.45
5.83 0.03 1.14 0.32
5.83
5.11 3.22 3.56 8.36
7.65
ns
100 A
16 mA
Std.
0.60
7.81 0.04 1.52 0.43
7.81
6.85 4.32 4.76 11.20 10.24
ns
–1
0.51
6.64 0.04 1.29 0.36
6.64
5.82 3.67 4.05 9.53
8.71
ns
–2
0.45
5.83 0.03 1.14 0.32
5.83
5.11 3.22 3.56 8.36
7.65
ns
Notes:
1. The minimum drive strength for any LVCMOS 3.3 V software configuration when run in wide range is ±100 A. Drive
strength displayed in the software is supported for normal range only. For a detailed I/V curve, refer to the IBIS models.
2. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-6 for derating values.
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