參數(shù)資料
型號： M5LV-256/68-15YI
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 13/42頁
文件大小： 0K
描述： IC CPLD 256MC 68I/O 100PQFP
標(biāo)準(zhǔn)包裝： 66
系列： MACH® 5
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 15.0ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
宏單元數(shù)： 256
輸入/輸出數(shù)： 68
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-BQFP
供應(yīng)商設(shè)備封裝： 100-PQFP（14x20）
包裝： 托盤
20
MACH 5 Family
BLOCK DIAGRAM — M5(LV)-512/XXX
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
Control
Generator
64
PT
2
PT
OE
16
32
7
PT
7
2
32
16
I/O
Cells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Macrocells
Control
Generator
64
PT
2
PT
OE
16
32
7
PT
7
2
32
16
I/O
Cells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Block
A/Macrocells
0-15
Block
D/Macrocells
0-15
Block
B/Macrocells
0-15
Block
C/Macrocells
0-15
Block
Interconnect
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
64
x
73
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Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
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32
7
PT
7
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32
16
Macrocells
Control
Generator
64
PT
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PT
OE
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32
7
PT
7
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32
16
I/O
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64
x
73
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Logic
Array
and
Logic
Allocator
Macrocells
Control
Generator
64
PT
2
PT
OE
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32
7
PT
7
2
32
16
I/O
Cells
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x
73
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and
Logic
Allocator
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Block
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x
73
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and
Logic
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Control
Generator
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PT
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I/O
Cells
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32
7
PT
7
2
32
16
Macrocells
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x
73
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Logic
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Logic
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Control
Generator
64
PT
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32
7
PT
7
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32
16
Macrocells
Control
Generator
64
PT
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PT
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32
7
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7
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x
73
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Logic
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Logic
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Control
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32
7
PT
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Block
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Macrocells
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x
73
AND
Logic
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and
Logic
Allocator
Control
Generator
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PT
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PT
OE
I/O
Cells
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32
7
PT
7
2
32
16
Macrocells
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x
73
AND
Logic
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Logic
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Control
Generator
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Macrocells
Control
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I/O
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64
x
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Logic
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Macrocells
Control
Generator
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32
7
PT
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IN
T
E
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E
C
T
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6
SEGMENT
5
SEGMENT
4
SEGMENT
3
I 3
I 2
20446G-013
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