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參數(shù)資料
| 型號： | M38B79MFH-XXXXFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 4.2 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 13/414頁 |
| 文件大小： | 4296K |
| 代理商： | M38B79MFH-XXXXFP |
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38B7 Group User’s Manual
List of figures
CHAPTER 1 HARDWARE
Fig. 1 Pin configuration of M38B79MFH-XXXXFP .................................................................... 1-3
Fig. 2 Functional block diagram ................................................................................................... 1-4
Fig. 3 Part numbering .................................................................................................................... 1-7
Fig. 4 Memory expansion plan ..................................................................................................... 1-8
Fig. 5 740 Family CPU register structure................................................................................... 1-9
Fig. 6 Register push and pop at interrupt generation and subroutine call ......................... 1-10
Fig. 7 Structure of CPU mode register ..................................................................................... 1-12
Fig. 8 Memory map diagram ...................................................................................................... 1-13
Fig. 9 Memory map of special function register (SFR) .......................................................... 1-14
Fig. 10 Structure of pull-up control registers (PULL1, PULL2 and PULL3) ........................ 1-15
Fig. 11 Port block diagram (1) ................................................................................................... 1-18
Fig. 12 Port block diagram (2) ................................................................................................... 1-19
Fig. 13 Port block diagram (3) ................................................................................................... 1-20
Fig. 14 Interrupt control ............................................................................................................... 1-23
Fig. 15 Structure of interrupt related registers ........................................................................ 1-23
Fig. 16 Structure of timer related register ................................................................................ 1-24
Fig. 17 Block diagram of timer .................................................................................................. 1-25
Fig. 18 Timing chart of timer 6 PWM1 mode ........................................................................... 1-26
Fig. 19 Block diagram of timer X .............................................................................................. 1-28
Fig. 20 Structure of timer X related registers .......................................................................... 1-28
Fig. 21 Block diagram of serial I/O1 ......................................................................................... 1-29
Fig. 22 Structure of serail I/O1 control registers 1, 2 ............................................................ 1-30
Fig. 23 Structure of serial I/O1 control register 3 ................................................................... 1-31
Fig. 24 Structure of serial I/O1 automatic transfer data pointer ........................................... 1-32
Fig. 25 Automatic transfer serial I/O operation ....................................................................... 1-33
Fig. 26 SSTB1 output operation .................................................................................................... 1-34
Fig. 27 SBUSY1 input operation (internal synchronous clock) ................................................... 1-34
Fig. 28 SBUSY1 input operation (external synchronous clock) .................................................. 1-34
Fig. 29 SBUSY1 output operation (internal synchronous clock, 8-bits serial I/O) ................... 1-35
Fig. 30 SBUSY1 output operation (external synchronous clock, 8-bits serial I/O) .................. 1-35
Fig. 31 SBUSY1 output operation in automatic transfer serial I/O mode (internal synchronous
clock, SBUSY1 output function outputs each 1-byte) ................................................... 1-35
Fig. 32 SRDY1 output operation .................................................................................................... 1-36
Fig. 33 SRDY1 input operation (internal synchronous clock) .................................................... 1-36
Fig. 34 Handshake operation at serial I/O1 mutual connecting (1) ...................................... 1-37
Fig. 35 Handshake operation at serial I/O1 mutual connecting (2) ...................................... 1-37
Fig. 36 Block diagram of clock snchronous serial I/O2 ......................................................... 1-38
Fig. 37 Operation of clock synchronous serial I/O2 function ................................................ 1-38
Fig. 38 Block diagram of UART serial I/O2 ............................................................................. 1-39
Fig. 39 Operation of UART serial I/O2 function ...................................................................... 1-39
Fig. 40 Structure of serial I/O2 related register ...................................................................... 1-41
Fig. 41 Block diagram of serial I/O3 ......................................................................................... 1-42
Fig. 42 Structure of serial I/O3 control register ....................................................................... 1-42
Fig. 43 Timing of serial I/O3 (LSB first) ................................................................................... 1-43
Fig. 44 Block diagram for FLD control circuit .......................................................................... 1-45
Fig. 45 Structure of FLDC related registers (1) ...................................................................... 1-46
Fig. 46 Structure of FLDC related registers (2) ...................................................................... 1-47
相關PDF資料 |
PDF描述 |
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