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參數(shù)資料
| 型號(hào)： | M38226MCMFS |
| 廠商： | Mitsubishi Electric Corporation |
| 元件分類： | FPGA |
| 英文描述： | 50000 SYSTEM GATE 2.5 VOLT FPGA - NOT RECOMMENDED for NEW DESIGN |
| 中文描述： | 單芯片8位CMOS微機(jī) |
| 文件頁(yè)數(shù)： | 52/78頁(yè) |
| 文件大?。?/td> | 998K |
| 代理商： | M38226MCMFS |
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56
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER
3822 Group
MITSUBISHI MICROCOMPUTERS
Table 28 Electrical characteristics (Extended operating temperature version)
(VCC =2.0 to 5.5 V, Ta = –20 to 85 °C, and VCC = 3.0 to 5.5 V, Ta = –40 to –20 °C, unless otherwise noted)
IOL = 10 mA
IOL = 2.5 mA
VCC = 3.0 V
IOL = 5 mA
IOL = 1.25 mA
VCC = 3.0 V
VOL
IOH = –2.5 mA
IOH = –0.6 mA
VCC = 3.0 V
IOH = –5 mA
IOH = –1.25 mA
VCC = 3.0 V
V
VCC–2.0
“H” output voltage
P00–P07, P10–P17
Symbol
Parameter
Limits
Min.
Unit
0.5
Typ.
Max.
Test conditions
VOH
2.0
0.5
RESET : VCC = 2.0 V to 5.5 V
VI = VCC
Pull-downs “off”
VCC = 5 V, VI = VCC
Pull-downs “on”
VCC = 3 V, VI = VCC
Pull-downs “on”
VI = VCC
“H” output voltage
P20–P27, P41–P47, P50–P57, P60–P67,
P70, P71 (Note)
“L” output voltage
P00–P07, P10–P17
“L” output voltage
P20–P27, P41–P47, P50–P57, P60–P67,
P70, P71 (Note)
Hysteresis
INT0–INT3, ADT, CNTR0, CNTR1, P20–P27
Hysteresis
SCLK, RXD
Hysteresis
RESET
“H” input current
P00–P07, P10–P17, P34–P37
“H” input current
P20–P27, P40–P47, P50–P57, P60–P67,
P70, P71 (Note)
VOH
VOL
VT+ – VT–
IIH
VCC–2.0
VCC–0.5
30
6.0
–30
–6.0
0.5
70
2.0
0.5
55
170
5.0
–5.0
–140
–45
V
IIH
IIL
VCC–0.9
V
1.1
V
1.1
5.0
A
25
VI = VCC
VI = VSS
Pull-ups “off”
VCC = 5 V, VI = VSS
Pull-ups “on”
VCC = 3 V, VI = VSS
Pull-ups “on”
VI = VSS
“H” input current
RESET
“H” input current
XIN
“L” input current
P00–P07, P10–P17, P34–P37,P40
“L” input current
P20–P27, P41–P47, P50–P57, P60–P67,
P70, P71 (Note)
“L” input current
RESET
“L” input current
XIN
4.0
–5.0
–70
A
IIL
–25
–4.0
Note: When “1” is set to port XC switch bit (bit 4 at address 003B16) of CPU mode register, the drive ability of port P70 is different from the value above men-
tioned.
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