參數(shù)資料
型號： M38207M8-117HP
廠商： Mitsubishi Electric Corporation
元件分類： DC/DC變換器
英文描述： 1 watt dc-dc converters
中文描述： 1瓦的DC - DC轉(zhuǎn)換器
文件頁數(shù)： 205/344頁
文件大?。?/td> 5067K
代理商： M38207M8-117HP
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APPLICATION
2.5 Serial I/O1
3820 GROUP USER’S MANUAL
2–119
After the lapse of a 1/2 period of the shift
clock from a reception start of stop bit, the
receive buffer full flag (bit 1) of the serial
I/O1 status register is set to “1.” And a serial
I/O1 receive interrupt request occurs.
Error flag detection is performed concurrently
with the occurrence of a serial I/O1 receive
interrupt request.
8
4: The receive buffer full flag is cleared to “0”
by reading out the receive buffer register.
Fig. 2.5.12 Receive timing example in UART mode
(3) Processing upon occurrence of errors
I
Parity error, framing error, or summing error
When a parity error, a framing error, or a summing error occurs, the flag corresponding to each error
in the serial I/O1 status register is set to “1.” These flags are not cleared to “0” automatically, so set
them to “0” by software.
These flags are set to “0” by one of the following operations.
Set the receive enable bit to “0”
Write data (arbitrary) into the serial I/O1 status register
I
Overrun error
An overrun error occurs when data is already input in the receive buffer register and yet all data is
input in the receive shift register.
If an overrun error occurs, the data of the receive shift register is not transferred and the data of the
receive buffer register is held. At this time, even if the data of the receive buffer register is read out,
the data of the receive shift register is not transferred.
Consequently, the data of the receive shift register becomes unreadable, so that the receive data
becomes invalid.
If an overrun error occurs, after set the overrun error flag of the serial I/O1 status register to “0,”
perform a receive operation again.
The overrun error flag is set to “0” by one of the following operations.
Set the serial I/O1 enable bit to “0”
Set the receive enable bit to “0”
Write data (arbitrary) into the serial I/O1 status register
D
6
PAR
SP
SP
D
0
ST
Write “1”
D
0
D
1
D
2
Shift clock
Receive enable bit
R
X
D
ST
Start receiving at falling of ST
Check that ST is “L” level
Serial I/O1 status
register
[Address 19
16
]
b1
Shift clock
R
X
D (SP)
1
0
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PDF描述
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M38207RFS 制造商:Renesas Electronics Corporation 功能描述:EMULATION MCU/8BIT CMOS EMULATION CHIP - Bulk
M3821 BK001 制造商:Alpha Wire 功能描述:CBL 25COND 18AWG BLK 1000'
M3821 BK002 制造商:Alpha Wire 功能描述:CBL 25COND 18AWG BLK 500'
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