參數(shù)資料
型號(hào)： M37902FHCHP
元件分類(lèi)： 微控制器/微處理器
英文描述： 16-BIT, FLASH, MICROCONTROLLER, PQFP100
封裝： 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100
文件頁(yè)數(shù)： 275/556頁(yè)
文件大?。?/td> 3722K
代理商： M37902FHCHP
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STOP AND WAIT MODES
7902 Group User’s Manual
16-9
16.3 Stop mode
Before executing the STP instruction, be sure to enable an interrupt which is to be used for the stop mode
termination.
Also, make sure that the interrupt priority level of an interrupt to be used for the termination is higher than
the processor interrupt priority level (IPL) of a routine where the STP instruction is executed.
After oscillation starts (), there is a possibility that each interrupt request occurs until the supply of
φCPU,
φBIU starts (). The interrupt requests which occurred during this period are accepted in order of priority
after the watchdog timer’s MSB becomes “0.” (When the level sense of an INT i interrupt is used, however,
no interrupt request is retained. Therefore, if pin INTi is at the invalid level when the watchdog timer’s MSB
becomes “0,” no interrupt request is accepted.) For an interrupt which has no need to be accepted, be sure
to set its interrupt priority level to “0” (Interrupt disabled) before executing the STP instruction.
16.3.2 Terminate operation at interrupt request occurrence (when not using watchdog timer)
At the stop mode termination, an instruction is executed without use of the watchdog timer. (See Figure
16.3.1.)
When an interrupt request occurs, clock input from pin XIN starts. Simultaneously, supply of clocks fsys,
φ1, f1 to f4096, Wf32, Wf512 starts.
Supply of
φCPU, φBIU starts after the time listed in Table 16.3.2 has elapsed.
The interrupt request which occurred in is accepted.
Watchdog timer clock source
select bit at STP termination
(bits 7, 6 at address 6116)
00
01
10
11
fXIN ! 19 cycles
fXIN ! 11 cycles
fXIN ! 67 cycles
fXIN ! 35 cycles
Time until supply of
φCPU and φBIU starts
Table 16.3.2 Time after stop mode is terminated
until supply of
φCPU, φBIU starts
Before executing the STP instruction, be sure to set as follows:
s Enable an interrupt which is to be used for the stop mode termination.
Also, make sure that the interrupt priority level of an interrupt to be used for the termination is higher
than the processor interrupt priority level (IPL) of a routine where the STP instruction is executed.
s The external clock input select bit (bit 1 at address 6216) = “1” (Note)
s The system clock select bit (bit 5 at address BC16) = “0” (Note)
Note: Simultaneously, the oscillation driver circuit between pins XIN and XOUT stops, and the output level
at pin XOUT is kept “H.” (Refer to section “17.4 Stop of oscillation circuit.”)
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