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參數(shù)資料
| 型號： | M34501M2-XXXFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 4-BIT, MROM, 4.4 MHz, MICROCONTROLLER, PDSO20 |
| 封裝： | 0.300 INCH, PLASTIC, SOP-20 |
| 文件頁數(shù)： | 52/213頁 |
| 文件大?。?/td> | 3014K |
| 代理商： | M34501M2-XXXFP |
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APPLICATION
2.3 Timers
2-27
4501 Group User’s Manual
Fig. 2.3.4 CNTR output setting example
0
b3b0
Disable Interrupts
Timer 1 interrupt is temporarily disabled.
Interrupt enable flag INTE
Interrupt control register V1
“0”
All interrupts disabled (DI instruction)
Timer 1 interrupt occurrence disabled
(TV1A instruction)
b3b0
0 0
Stop Timer Operation
Timer 1 and prescaler are temporarily stopped.
Dividing ratio of prescaler is selected.
Timer control register W1
Timer 1 stop (TW1A instruction)
Prescaler stop
Prescaler divided by 4 selected
0
Set Timer Value, Select CNTR Output
CNTR output is selected.
Timer 1 count time is set.
Timer control register W6
Timer 1 reload register R1 “2916”
Timer count value 41 set (T1AB instruction)
b3
b0
1
0
CNTR output selected (TW6A instruction)
Clear Interrupt Request
Timer 1 interrupt activated condition is cleared.
Timer 1 interrupt request flag T1F “0”
Timer 1 interrupt activated condition cleared
(SNZT1 instruction)
Note when the interrupt request is cleared
When is executed, considering the skip of the next instruction according to the
interrupt request flag T1F, insert the NOP instruction after the SNZT1 instruction.
Start Timer 1 Operation
Timer 1 and prescaler temporarily stopped are restarted.
Timer 1 operation start (TW1A instruction)
Prescaler operation start
b3b0
1 0
Timer control register W1
0
1
b3
b0
1
Enable Interrupts
The timer 1 interrupt which is temporarily disabled is enabled.
Interrupt control register V1
“1”
Timer 1 interrupt occurrence enabled
(TV1A instruction)
All interrupts enabled (EI instruction)
b3
b0
0
Stop CNTR Output
P12/CNTR I/O port is set to CNTR input port, and it is set to the high-impedance state.
Timer control register W6
CNTR input pin set (TW6A instruction)
0
“”: it can be “0” or “1.”
0
Interrupt enable flag INTE
Input mode is set. (OP1A instruction)
Output latch of port P12
b3b0
1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M34501E4FP | 4-BIT, OTPROM, 4.4 MHz, MICROCONTROLLER, PDSO20 |
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| M34501E4FP | 4-BIT, OTPROM, MICROCONTROLLER, PDSO20 |
| M34501M4-XXXFP | 4-BIT, MROM, MICROCONTROLLER, PDSO20 |
| M34501E4FP | 4-BIT, OTPROM, MICROCONTROLLER, PDSO20 |
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參數(shù)描述 |
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