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參數(shù)資料
| 型號(hào)： | M30624MGA-322FP |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | QUID+OSINE FUNCTION |
| 中文描述： | 單片16位CMOS微機(jī) |
| 文件頁(yè)數(shù)： | 226/274頁(yè) |
| 文件大?。?/td> | 3495K |
| 代理商： | M30624MGA-322FP |
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CPU Rewrite Mode (Flash Memory Version)
Mitsubishi microcomputers
M16C / 62A Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
226
Command
Page program
Clear status register
Read array
Read status register
X
X
X
X
(Note 3)
First bus cycle
Second bus cycle
Third bus cycle
FF
16
70
16
50
16
41
16
Write
Write
Write
Write
X
SRD
Read
Write
Lock bit program
X
77
16
Write
BA
D0
16
Write
Erase all unlock block
X
A7
16
Write
X
D0
16
Write
WA1
WD1
Write
(Note 2)
WA0
(Note 3)
WD0
(Note 3)
Block erase
X
20
16
Write
D0
16
Write
BA
(Note 4)
Read lock bit status
X
71
16
Write
BA
D
6
Read
(Note 5)
Mode
Address
Mode
Address
Mode
Address
Data
(D
0
to D
7
)
Data
(D
0
to D
7
)
Data
(D
0
to D
7
)
(Note 6)
Note 1: When a software command is input, the high-order byte of data (D
8
to D
15
) is ignored.
Note 2: SRD = Status Register Data
Note 3: WA = Write Address, WD = Write Data
WA and WD must be set sequentially from 00
16
to FE
16
(byte address; however, an even address). The page size is
256 bytes.
Note 4: BA = Block Address (Enter the maximum address of each block that is an even address.)
Note 5: D
6
corresponds to the block lock status. Block not locked when D
6
= 1, block locked when D
6
= 0.
Note 6: X denotes a given address in the user ROM area (that is an even address).
Software Commands
Table 1.26.1 lists the software commands available with the M16C/62A (flash memory version).
After setting the CPU rewrite mode select bit to 1, write a software command to specify an erase or
program operation. Note that when entering a software command, the upper byte (D
8
to D
15
) is ignored.
The content of each software command is explained below.
Table 1.26.1. List of software commands (CPU rewrite mode)
Read Array Command (FF
16
)
The read array mode is entered by writing the command code
“
FF
16
”
in the first bus cycle. When an
even address to be read is input in one of the bus cycles that follow, the content of the specified
address is read out at the data bus (D
0
–
D
15
), 16 bits at a time.
The read array mode is retained intact until another command is written.
Read Status Register Command (70
16
)
When the command code
“
70
16
”
is written in the first bus cycle, the content of the status register is
read out at the data bus (D
0
–
D
7
) by a read in the second bus cycle.
The status register is explained in the next section.
Clear Status Register Command (50
16
)
This command is used to clear the bits SR3 to 5 of the status register after they have been set. These
bits indicate that operation has ended in an error. To use this command, write the command code
“
50
16
”
in the first bus cycle.
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