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參數(shù)資料
| 型號： | M30622MA-XXXFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 16-BIT, MROM, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 398/620頁 |
| 文件大?。?/td> | 7864K |
| 代理商： | M30622MA-XXXFP |
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Power Control
Mitsubishi microcomputers
M16C / 62 Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
443
2.14.2 Stop Mode Set-Up
(1) Enables the interrupt used for returning from stop mode.
(2) Sets the interrupt enable flag (I flag) to “1”.
(3) Clearing the protection and setting all clock stop control bit to “1” stops oscillation and causes
the processor to go into stop mode.
Operation
Settings and operation for entering stop mode are described here.
Figure 2.14.5. Example of stop mode set-up
All clocks off (stop mode)
b7
b0
(3) Canceling protect
Protect register [Address 000A16]
PRCR
1
Enables writing to system clock control registers 0 and 1(
addresses 000616 and 000716)
1 : Write-enabled
(3) All clocks off (stop mode)
b7
b0
System clock control register [Address 000716]
CM1
0000
Reserved bit
Must be set to “0”
All clock stop control bit
1 : All clocks off (stop mode)
1
Interrupt control register
TBiIC(i=3 to 5)
[Address 004516 to 004716]
BCNIC
[Address 004A16]
KUPIC
[Address 004D16]
SiTIC(i=0 to 2)
[Address 005116, 005316, 004F16]
SiRIC(i=0 to 2)
[Address 005216, 005416, 005016]
TAiIC(i=0 to 4)
[Address 005516 to 005916]
TBiIC(i=0 to 2)
[Address 005A16 to 005C16]
(1) Setting interrupt to cancel stop mode
Make sure that the interrupt priority
level of the interrupt which is used to
cancel the wait mode is higher than
the processor interrupt priority(IPL) of
the routine where the WAIT
instruction is executed.
Interrupt priority level select bit
b7
b0
INTiIC(i=3)
[Address 004416]
SiIC/INTjIC(i=4, 3)
[Address 004816, 004916]
(j=3, 4)
[Address 004816, 004916]
INTiIC(i=0 to 2)
[Address 005D16 to 005F16]
Make sure that the interrupt priority level of the
interrupt which is used to cancel the wait mode is
higher than the processor interrupt priority(IPL) of
the routine where the WAIT instruction is executed.
Interrupt priority level select bit
b7
b0
0
Reserved bit
Must be set to “0”
System clock control register
[Address 000616] CM0
(3) Setting operation clock after returning from stop mode
On
Main clock (XIN-XOUT) stop bit
b7
b0
System clock select bit
XIN, XOUT
As this register becomes setting mentioned above when
operating with XIN (count source of BCLK is XIN),
the user does not need to set it again.
00
System clock control register 0
[Address 000616] CM0
XCIN-XCOUT generation
Port XC select bit
b7
b0
System clock select bit
XCIN, XCOUT
As this register becomes setting mentioned above when operating with XCIN
(count source of BCLK is XCIN), the user does not need to set it again.
When operating with XIN, set port Xc select bit to “1” before setting system clock
select bit to “1”. The both bits cannot be set at the same time.
1
(When operating with XCIN after returning)
(When operating with XIN after returning)
(2) Interrupt enable flag (I flag)
“1”
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