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參數(shù)資料
| 型號： | M30620MC-D37FP |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER |
| 中文描述： | 單片16位CMOS微機 |
| 文件頁數(shù)： | 26/274頁 |
| 文件大?。?/td> | 3495K |
| 代理商： | M30620MC-D37FP |
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Mitsubishi microcomputers
M16C / 62A Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
Bus Settings
26
P0
0
to P0
7
I/O port
Data bus
Data bus
Data bus
Data bus
I/O port
Either CS1 or CS2 is for
multiplexed bus and others
are for separate bus
(separate bus)
multiplexed
bus for the
entire
space
8 bit
“H”
Single-chip
mode
Memory expansion mode/microprocessor modes
Memory
expansion mode
Data bus width
BYTE pin level
Port P4
0
to P4
3
function select bit = 0
“01”, “10”
“00”
“11” (Note 1)
8 bits
“H”
16 bits
“L”
8 bits
“H”
16 bits
“L”
Note 1: If the entire space is of multiplexed bus in memory expansion mode, choose an 8-bit width.
The processor operates using the separate bus after reset is revoked, so the entire space multiplexed bus cannot be
chosen in microprocessor mode.
The higher-order address becomes a port if the entire space multiplexed bus is chosen, so only 256 bytes can be used
in each chip select.
Note 2: Address bus when in separate bus mode.
Processor mode
Multiplexed bus
space select bit
CS (chip select) or programmable I/O port
(For details, refer to “Bus control”)
Outputs RD, WRL, WRH, and BCLK or RD, BHE, WR, and BCLK
(For details, refer to “Bus control”)
Port P4
0
to P4
3
function select bit = 1
P1
0
to P1
7
I/O port
I/O port
Data bus
I/O port
Data bus
I/O port
P2
1
to P2
7
I/O port
Address bus
/data bus
(Note 2)
Address bus
/data bus
(Note 2)
Address bus
Address bus
Address bus
/data bus
P2
0
I/O port
Address bus
/data bus
(Note 2)
Address bus
Address bus
Address bus
Address bus
/data bus
P3
0
I/O port
Address bus
Address bus
/data bus
(Note 2)
Address bus
Address bus
A
8
/D
7
P3
1
to P3
7
I/O port
Address bus
Address bus
Address bus
Address bus
I/O port
P4
0
to P4
3
I/O port
I/O port
I/O port
/O port
I/O port
I/O port
P4
0
to P4
3
I/O port
Address bus
Address bus
Address bus
Address bus
I/O port
P4
4
to P4
7
I/O port
P5
0
to P5
3
I/O port
P5
4
I/O port
HLDA
HLDA
HLDA
HLDA
HLDA
P5
5
I/O port
HOLD
HOLD
HOLD
HOLD
HOLD
P5
6
I/O port
ALE
ALE
ALE
ALE
ALE
P5
7
I/O port
RDY
RDY
RDY
RDY
RDY
Table 1.8.2. Pin functions for each processor mode
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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