參數(shù)資料
型號： M2V64S40BTP-7L
廠商： Mitsubishi Electric Corporation
英文描述： 64M bit Synchronous DRAM
中文描述： 6400位同步DRAM
文件頁數(shù)： 3/52頁
文件大?。?/td> 674K
代理商： M2V64S40BTP-7L
Apr. '99
MITSUBISHI LSIs
MITSUBISHI ELECTRIC
SDRAM (Rev.1.2)
M2V64S20BTP-7,-7L,-8,-8L,-8A,-10,-10L (4-BANK x 4194304-WORD x 4-BIT)
M2V64S30BTP-7,-7L,-8,-8L,-8A,-10,-10L (4-BANK x 2097152-WORD x 8-BIT)
M2V64S40BTP-7,-7L,-8,-8L,-8A,-10,-10L (4-BANK x 1048576-WORD x 16-BIT)
64M bit Synchronous DRAM
3
BLOCK DIAGRAM
Address Buffer
A0-11
BA0,1
Control Signal Buffer
/CS /RAS /CAS /WE DQM
CLK
CKE
Clock Buffer
Memory Array
Bank #0
Control Circuitry
I/O Buffer
DQ0-3 (x4)
DQ0-7 (x8)
DQ0-15 (x16)
Mode
Register
Memory Array
Bank #1
Memory Array
Bank #2
Memory Array
Bank #3
Type Designation Code
M2 V 64 S 2 0 B TP - 7
Access Item
Package Type TP: TSOP(II)
Process Generation
Function 0: Random Column
Organization 2n 2: x4, 3: x8, 4: x16
Synchronous DRAM
Density 64:64M bits
Interface S: SSTL, V:LVTTL
Mitsubishi Semiconductor Memory
This rule is applied only to Synchronous DRAM families beyond 64M B-version.
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PDF描述
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