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參數(shù)資料
| 型號： | M2V64S40BTP-6 |
| 廠商： | Mitsubishi Electric Corporation |
| 英文描述： | 64M bit Synchronous DRAM |
| 中文描述： | 6400位同步DRAM |
| 文件頁數(shù)： | 47/52頁 |
| 文件大?。?/td> | 674K |
| 代理商： | M2V64S40BTP-6 |
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MITSUBISHI LSIs
MITSUBISHI ELECTRIC
A
0-9 *
A
10
DQM(U/L)
A
11
Apr. '99
SDRAM (Rev.1.2)
M2V64S20BTP-7,-7L,-8,-8L,-8A,-10,-10L (4-BANK x 4194304-WORD x 4-BIT)
M2V64S30BTP-7,-7L,-8,-8L,-8A,-10,-10L (4-BANK x 2097152-WORD x 8-BIT)
M2V64S40BTP-7,-7L,-8,-8L,-8A,-10,-10L (4-BANK x 1048576-WORD x 16-BIT)
64M bit Synchronous DRAM
* A9 (x8) and A8,A9 (x16) for column address of read/write are don't care
47
Self-Refresh
/CS
/RAS
/CAS
/WE
CKE
BA0,1
DQ
Self-Refresh Entry
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
CLK
Before Self-Refresh Entry,
all banks must be idle state.
X
X
X
0
Self-Refresh Exit
ACT#0
After tRC from Self-Refresh Exit,
all banks are idle state.
tRC+1
tSRX
CLK can be stopped
CKE must be low to maintain Self-Refresh
Italic parameter
indicates minimum case
相關PDF資料 |
PDF描述 |
|---|---|
| M2V64S40BTP-7 | 64M bit Synchronous DRAM |
| M2V64S40BTP-7L | 64M bit Synchronous DRAM |
| M2V64S40BTP-8 | 64M bit Synchronous DRAM |
| M2V64S40BTP-8A | 64M bit Synchronous DRAM |
| M2V64S40BTP-8L | 64M bit Synchronous DRAM |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| M2V64S40BTP-7 | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:64M bit Synchronous DRAM |
| M2V64S40BTP-7L | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:64M bit Synchronous DRAM |
| M2V64S40BTP-8 | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:64M bit Synchronous DRAM |
| M2V64S40BTP-8A | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:64M bit Synchronous DRAM |
| M2V64S40BTP-8L | 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:64M bit Synchronous DRAM |
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