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參數資料
| 型號： | M1AFS600-2PQ208 |
| 廠商： | Microsemi SoC |
| 文件頁數： | 65/334頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 4MB FLASH 600K 208-PQFP |
| 標準包裝： | 24 |
| 系列： | Fusion® |
| RAM 位總計： | 110592 |
| 輸入/輸出數： | 95 |
| 門數： | 600000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 208-BFQFP |
| 供應商設備封裝： | 208-PQFP（28x28） |
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Fusion Family of Mixed Signal FPGAs
Revision 4
2-141
I/O Registers
Each I/O module contains several input, output, and enable registers. Refer to Figure 2-100 for a
simplified representation of the I/O block.
The number of input registers is selected by a set of switches (not shown in Figure 2-100) between
registers to implement single or differential data transmission to and from the FPGA core. The Designer
software sets these switches for the user.
A common CLR/PRE signal is employed by all I/O registers when I/O register combining is used. Input
register 2 does not have a CLR/PRE pin, as this register is used for DDR implementation. The I/O
register combining must satisfy some rules.
Note: Fusion I/Os have registers to support DDR functionality (see the "Double Data Rate (DDR) Support" section on
page 2-142 for more information).
Figure 2-100 I/O Block Logical Representation
Input
Reg
E = Enable Pin
A
Y
PAD
1
2
3
4
5
6
OCE
ICE
Input
Reg
Input
Reg
CLR/PRE
Pull-Up/Down
Resistor Control
Signal Drive Strength
and Slew-Rate Control
Output
Reg
Output
Reg
To FPGA Core
From FPGA Core
Output
Enable
Reg
OCE
I/O / CLR or I/O / PRE / OCE
I/O / Q0
I/O / Q1
I/O / ICLK
I/O / D0
I/O / D1 / ICE
I/O / OCLK
I/O / OE
相關PDF資料 |
PDF描述 |
|---|---|
| ACC43DRTI-S93 | CONN EDGECARD 86POS DIP .100 SLD |
| M1AFS600-2PQG208 | IC FPGA 4MB FLASH 600K 208-PQFP |
| FMC12DREN-S734 | CONN EDGECARD 24POS .100 EYELET |
| 5207908-1 | CONN BACKSHELL DB9 PLASTIC |
| AFS600-2PQG208 | IC FPGA 4MB FLASH 600K 208PQFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
| M1AFS600-2PQ208I | 功能描述:IC FPGA 4MB FLASH 600K 208-PQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Fusion® 產品培訓模塊:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色產品:Cyclone? IV FPGAs 標準包裝:60 系列:CYCLONE® IV GX LAB/CLB數:9360 邏輯元件/單元數:149760 RAM 位總計:6635520 輸入/輸出數:270 門數:- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應商設備封裝:484-FBGA（23x23） |
| M1AFS600-2PQ256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS600-2PQ256I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS600-2PQ256PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS600-2PQG208 | 功能描述:IC FPGA 4MB FLASH 600K 208-PQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Fusion® 標準包裝:40 系列:SX-A LAB/CLB數:6036 邏輯元件/單元數:- RAM 位總計:- 輸入/輸出數:360 門數:108000 電源電壓:2.25 V ~ 5.25 V 安裝類型:表面貼裝 工作溫度:0°C ~ 70°C 封裝/外殼:484-BGA 供應商設備封裝:484-FPBGA（27X27） |
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