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參數資料
| 型號： | M1AFS250-FPQG208 |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 250000 GATES, PQFP208 |
| 封裝： | 0.50 MM PITCH, GREEN, PQFP-208 |
| 文件頁數： | 163/318頁 |
| 文件大?。?/td> | 10129K |
| 代理商： | M1AFS250-FPQG208 |
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Actel Fusion Mixed-Signal FPGAs
Pr el iminar y v1 .7
2- 229
Advance v0.9
(continued)
A note was added to Table2-16RTC ACM Memory Map.
A reference to the Peripheral’s User’s Guide was added to the "Voltage
In Table 2-25 Flash Memory Block Timing, the commercial conditions were
updated.
In Table 2-26 FlashROM Access Time, the commercial conditions were missing
and have been added below the title of the table.
In Table 2-36 Analog Block Pin Description, the function description was
updated for the ADCRESET.
In the "Voltage Monitor" section, the following sentence originally had ± 10%
and it was changed to +10%.
The Analog Quad inputs are tolerant up to 12 V + 10%.
In addition, this statement was deleted from the datasheet:
Each I/O will draw power when connected to power (3 mA at 3 V).
The "Terminology" section is new.
The "Current Monitor" section was significantly updated. Figure 2-71 Timing
and
Measurement are new.
The "ADC Description" section was updated to add the "Terminology" section.
In the "Gate Driver" section, 25 mA was changed to 20 mA and 1.5 MHz was
changed to 1.3 MHz. In addition, the following sentence was deleted:
The maximum AG pad switching frequency is 1.25 MHz.
The "Temperature Monitor" section was updated to rewrite most of the text
In Table 2-38 Temperature Data Format, the temperature K column was
changed for 85°C from 538 to 358.
In Table 2-45 ADC Interface Timing, "Typical-Case" was changed to "Worst-
Case."
The "ADC Interface Timing" section is new.
Table 2-46 Analog Channel Specifications was updated.
The "VCC15A Analog Power Supply (1.5 V)" section was updated.
The "VCCPLA/B PLL Supply Voltage" section is new.
In "VCCNVM Flash Memory Block Power Supply (1.5 V)" section, supply was
changed to supply input.
The "VCCPLA/B PLL Supply Voltage" pin description was updated to include the
following statement:
Actel recommends tying VCCPLX to VCC and using proper filtering circuits to
decouple VCC noise from PLL.
The "VCOMPLA/B Ground for West and East PLL" section was updated.
In Table2-47ADC Characteristics in Direct Input Mode, the commercial
conditions were updated and note 2 is new.
Previous Version
Changes in Current Version (Preliminary v1.7)
Page
相關PDF資料 |
PDF描述 |
|---|---|
| M1AFS250-FQN180 | FPGA, 250000 GATES, PBCC180 |
| M1AFS250-FQNG180 | FPGA, 250000 GATES, PBCC180 |
| M1AFS250-FFG256 | FPGA, 250000 GATES, PBGA256 |
| M1AFS250-FFGG256 | FPGA, 250000 GATES, PBGA256 |
| M1AFS250-FPQ208 | FPGA, 250000 GATES, PQFP208 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| M1AFS250-FPQG256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FPQG256I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FPQG256PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FQN256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M1AFS250-FQN256I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
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