5-2 Revision 4 Revision 3 (continued) The drive strength, IOL, and IOH for 3.3 V GTL and 2.5 V GTL were changed from 25 mA t" />
參數(shù)資料
型號： M1AFS1500-FG256K
廠商： Microsemi SoC
文件頁數(shù)： 244/334頁
文件大?。?/td> 0K
描述： IC FPGA 8MB FLASH 1.5M 256-FBGA
標準包裝： 90
系列： Fusion®
RAM 位總計： 276480
輸入/輸出數(shù)： 119
門數(shù)： 1500000
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： -55°C ~ 100°C
封裝/外殼： 256-LBGA
供應(yīng)商設(shè)備封裝： 256-FPBGA（17x17）
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Datasheet Information
5-2
Revision 4
Revision 3
(continued)
The drive strength, IOL, and IOH for 3.3 V GTL and 2.5 V GTL were changed from
25 mA to 20 mA in the following tables (SAR 37373):
The following sentence was deleted from the "2.5 V LVCMOS" section (SAR 34800):
"It uses a 5 V–tolerant input buffer and push-pull output buffer."
Corrected the inadvertent error in maximum values for LVPECL VIH and VIL and
Levels, making these consistent with Table 3-1 Absolute Maximum Ratings, and
The maximum frequency for global clock parameter was removed from Table 2-5
Timing because a frequency on the global is only an indication of what the global
network can do. There are other limiters such as the SRAM, I/Os, and PLL.
SmartTime software should be used to determine the design frequency (SAR
36955).
Revision 2
(March 2012)
The phrase "without debug" was removed from the "Soft ARM Cortex-M1 Fusion
Advantages" section, and "Security" section were revised to clarify that although no
existing security measures can give an absolute guarantee, Microsemi FPGAs
implement the best security available in the industry (SAR 34679).
I, 1-2,
The Y security option and Licensed DPA Logo was added to the "Product Ordering
Codes" section. The trademarked Licensed DPA Logo identifies that a product is
covered by a DPA counter-measures license from Cryptography Research (SAR
34721).
The following information was added before Figure 2-17 XTLOSC Macro:
In the case where the Crystal Oscillator block is not used, the XTAL1 pin should be
connected to GND and the XTAL2 pin should be left floating (SAR 24119).
Table 2-12 Fusion CCC/PLL Specification was updated. A note was added
indicating that when the CCC/PLL core is generated by Microsemi core generator
software, not all delay values of the specified delay increments are available (SAR
34814).
shown for the AB macro) stating that the user is only required to instantiate the
VRPSM macro if the user wishes to specify PUPO behavior of the voltage regulator
to be different from the default, or employ user logic to shut the voltage regulator off
(SAR 21773).
Revision
Changes
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PDF描述
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M1AFS1500-FG484 功能描述:IC FPGA 8MB FLASH 1.5M 484-FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Fusion® 產(chǎn)品培訓模塊:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色產(chǎn)品:Cyclone? IV FPGAs 標準包裝:60 系列:CYCLONE® IV GX LAB/CLB數(shù):9360 邏輯元件/單元數(shù):149760 RAM 位總計:6635520 輸入/輸出數(shù):270 門數(shù):- 電源電壓:1.16 V ~ 1.24 V 安裝類型:表面貼裝 工作溫度:0°C ~ 85°C 封裝/外殼:484-BGA 供應(yīng)商設(shè)備封裝:484-FBGA（23x23）
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M1AFS1500-FG484K 功能描述:IC FPGA 8MB FLASH 1.5M 484-FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:Fusion® 標準包裝:1 系列:ProASICPLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計:129024 輸入/輸出數(shù):248 門數(shù):600000 電源電壓:2.3 V ~ 2.7 V 安裝類型:表面貼裝 工作溫度:- 封裝/外殼:352-BFCQFP，帶拉桿 供應(yīng)商設(shè)備封裝:352-CQFP（75x75）
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