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參數(shù)資料
| 型號(hào)： | M1A3PE3000-FGG896I |
| 廠商： | Microsemi SoC |
| 文件頁(yè)數(shù)： | 128/162頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 1KB FLASH 3M 896-FBGA |
| 標(biāo)準(zhǔn)包裝： | 27 |
| 系列： | ProASIC3E |
| RAM 位總計(jì)： | 516096 |
| 輸入/輸出數(shù)： | 620 |
| 門(mén)數(shù)： | 3000000 |
| 電源電壓： | 1.425 V ~ 1.575 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 896-BGA |
| 供應(yīng)商設(shè)備封裝： | 896-FBGA（31x31） |
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ProASIC3E DC and Switching Characteristics
2-54
Revision 13
Fully Registered I/O Buffers with Synchronous Enable and
Asynchronous Clear
Figure 2-26 Timing Model of the Registered I/O Buffers with Synchronous Enable and Asynchronous Clear
Enable
CLK
Pad
Out
CLK
Enable
CLR
Data_out
Data
Y
AA
EOUT
DOUT
Core
Array
DQ
DFN1E1C1
E
CLR
DQ
DFN1E1C1
E
CLR
DQ
DFN1E1C1
E
CLR
D_Enable
BB
CC
DD
EE
FF
GG
LL
HH
JJ
KK
CLKBUF
INBUF
TRIBUF
INBUF
CLKBUF
INBUF
Data Input I/O Register with
Active High Enable
Active High Clear
Positive-Edge Triggered
Data Output Register and
Enable Output Register with
Active High Enable
Active High Clear
Positive-Edge Triggered
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EEC43DTEH | CONN EDGECARD 86POS .100 EYELET |
| M1AGLE3000V5-FG896 | IC FPGA 1KB FLASH 3M 896-FBGA |
| ACC50DRYN | CONN EDGECARD 100PS .100 DIP SLD |
| ACC50DRYH | CONN EDGECARD 100PS .100 DIP SLD |
| AGLE3000V5-FG896 | IC FPGA 1KB FLASH 3M 896-FBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M1A3PE3000-FGG896PP | 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:ProASIC3E Flash Family FPGAs |
| M1A3PE3000-FPQ208 | 制造商:Microsemi Corporation 功能描述:FPGA PROASIC3E 3M GATES 193MHZ 130NM 1.5V 208PQFP - Trays |
| M1A3PE3000-FPQ896 | 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:ProASIC3E Flash Family FPGAs |
| M1A3PE3000-FPQ896ES | 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:ProASIC3E Flash Family FPGAs |
| M1A3PE3000-FPQ896I | 制造商:ACTEL 制造商全稱(chēng):Actel Corporation 功能描述:ProASIC3E Flash Family FPGAs |
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