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參數(shù)資料
| 型號： | M1A3P600-2FG484I |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 13824 CLBS, 600000 GATES, PBGA484 |
| 封裝： | 23 X 23 MM, 2.23 MM HEIGHT, 1 MM PITCH, FBGA-484 |
| 文件頁數(shù)： | 169/218頁 |
| 文件大?。?/td> | 6270K |
| 代理商： | M1A3P600-2FG484I |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁當(dāng)前第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁
ProASIC3 DC and Switching Characteristics
2- 40
v1.4
Table 2-49 Minimum and Maximum DC Input and Output Levels
Applicable to Standard I/O Banks
3.3 V LVCMOS
Wide Range
Equiv.
Software
Default
Drive
Strength
Option1
VIL
VIH
VOL
VOH
IOL IOH
IOSL
IOSH
IIL
2 I
IH
3
Drive Strength
Min.,
V
Max.,
V
Min.,
V
Max.,
V
Max.,
V
Min., V
μA μA Max., mA4 Max., mA4
A
5
A
5
100
μA
2 mA
–0.3
0.8
2
3.6
0.2
VDD –
0.2
100 100
TBD
10 10
100
μA
4 mA
–0.3
0.8
2
3.6
0.2
VDD –
0.2
100 100
TBD
10 10
100
μA
6 mA
–0.3
0.8
2
3.6
0.2
VDD –
0.2
100 100
TBD
10 10
100
μA
8 mA
–0.3
0.8
2
3.6
0.2
VDD –
0.2
100 100
TBD
10 10
Notes:
1. Please note that 3.3 V LVCMOS wide range is applicable to 100 A drive strength only. The configuration will
NOT operate at the equivalent software default drive strength. These values are for Normal Ranges ONLY.
2. IIL is the input leakage current per I/O pin over recommended operation conditions where –0.3 V < VIN < VIL.
3. IIH is the input leakage current per I/O pin over recommended operating conditions VIH < VIN < VCCI. Input
current is larger when operating outside recommended ranges
4. Currents are measured at 85°C junction temperature.
5. All LVMCOS 3.3 V software macros support LVCMOS 3.3 V wide range as specified in the JDEC8a
specification.
6. Software default selection highlighted in gray.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M1A3P600-2FG484 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PBGA484 |
| M1A3P600-2FGG144I | FPGA, 13824 CLBS, 600000 GATES, PBGA144 |
| M1A3P600-2FGG144 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PBGA144 |
| M1A3P600-2FGG256I | FPGA, 13824 CLBS, 600000 GATES, PBGA256 |
| M1A3P600-2FGG256 | FPGA, 13824 CLBS, 600000 GATES, 350 MHz, PBGA256 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| M1A3P600-2FGG144ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
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| M1A3P600-2FGG144PP | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC3 Flash Family FPGAs |
| M1A3P600-2FGG256 | 功能描述:IC FPGA 1KB FLASH 600K 256-FBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:ProASIC3 標(biāo)準(zhǔn)包裝:90 系列:ProASIC3 LAB/CLB數(shù):- 邏輯元件/單元數(shù):- RAM 位總計(jì):36864 輸入/輸出數(shù):157 門數(shù):250000 電源電壓:1.425 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 125°C 封裝/外殼:256-LBGA 供應(yīng)商設(shè)備封裝:256-FPBGA（17x17） |
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