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參數(shù)資料
| 型號： | LTC1650IS#PBF |
| 廠商： | Linear Technology |
| 文件頁數(shù)： | 7/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC D/A CONV 16BIT R-R 16-SOIC |
| 標(biāo)準(zhǔn)包裝： | 50 |
| 設(shè)置時間： | 4µs |
| 位數(shù)： | 16 |
| 數(shù)據(jù)接口： | 串行 |
| 轉(zhuǎn)換器數(shù)目： | 1 |
| 電壓電源： | 雙 ± |
| 功率耗散（最大）： | 50mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-SOIC |
| 包裝： | 管件 |
| 輸出數(shù)目和類型： | 1 電壓，單極；1 電壓，雙極 |
| 采樣率（每秒）： | * |
| 產(chǎn)品目錄頁面： | 1350 (CN2011-ZH PDF) |
4
LTC1650
The q denotes specifications which apply over the full operating
temperature range, otherwise specifications are at TA = 25°C. AVDD = 4.75V to 5.25V, AVSS = – 4.75V to – 5.25V, DVDD = 4.75V to
5.25V, REFLO = 0V, REFHI = 4.096V, VOUT unloaded, unless otherwise noted.
Note 5: Digital Inputs at 0V or DVDD.
Note 6: Measured at VOUT. REFHI = REFLO = 0V, unipolar mode.
Note 7: When part powers up or when it is reset, the output is connected
to VRST through this switch.
Note 8: Reset is active when any supply goes below this threshold.
Note 9: REFLO = 0V, REFHI = VREF. For REFLO ≠ 0V see Operation section.
Note 1: Absolute Maximum Ratings are those values beyond which the life
of a device may be impaired.
Note 2: Nonlinearity is defined from code 0 to code 65535 (full scale)
(end point INL, see Definitions section).
Note 3: Guaranteed by design. Not subject to test.
Note 4: To
±1LSB. Unipolar mode. DAC switched between all 1s and all 0s.
SYMBOL
PARAMETER
CONDITIONS
MIN
TYP
MAX
UNITS
Digital I/O Characteristics
VIH
Digital Input High Voltage
q
2.4
V
VIL
Digital Input Low Voltage
q
0.8
V
VOH
Digital Output High Voltage
IOUT = –1mA, DOUT Only
q
VCC – 1.0
V
VOL
Digital Output Low Voltage
IOUT = 1mA, DOUT Only
q
0.4
V
ILK
Digital Input Leakage
VIN = GND to VCC
q
±10
A
CIN
Digital Input Capacitance
(Note 3)
10
pF
Reset Characteristics
RON
VOUT and VRST Switch Resistance
VRST = 0.5V (Note 7)
q
200
500
Threshold Voltage for Reset
AVDD or DVDD (Note 8)
q
1.5
2.5
3.2
V
AVSS(Note 8)
q
1.5
2.5
3.2
V
Switching Characteristics
t1
DIN Valid to CLK Setup
q
40
ns
t2
DIN Valid to CLK Hold
q
0ns
t3
CLK High Time
(Note 3)
q
40
ns
t4
CLK Low Time
(Note 3)
q
40
ns
t5
CS/LD Pulse Width
(Note 3)
q
50
ns
t6
LSB CLK to CS/LD
(Note 3)
q
40
ns
t7
CS/LD Low to CLK
(Note 3)
q
20
ns
t8
DOUT Output Delay
CLOAD = 100pF
q
5
45
150
ns
t9
CLK Low to CS/LD Low
(Note 3)
q
20
ns
t10
CLR Pulse Width
q
50
ns
ELECTRICAL CHARACTERISTICS
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PDF描述 |
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參數(shù)描述 |
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